參數(shù)資料
型號： MPC8568EVTAUJJ
廠商： Freescale Semiconductor
文件頁數(shù)： 47/139頁
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描述： MPU POWERQUICC III 1023-PBGA
標(biāo)準(zhǔn)包裝： 24
系列： MPC85xx
處理器類型： 32-位 MPC85xx PowerQUICC III
速度： 1.333GHz
電壓： 1.1V
安裝類型： 表面貼裝
封裝/外殼： 1023-BBGA，F(xiàn)CBGA
供應(yīng)商設(shè)備封裝： 1023-FCPBGA（33x33）
包裝： 托盤
MPC8568E/MPC8567E PowerQUICC III Integrated Processor Hardware Specifications, Rev. 1
Freescale Semiconductor
15
Input Clocks
4
Input Clocks
4.1
System Clock Timing
Table 7 provides the system clock (SYSCLK) AC timing specifications for the MPC8568E.
eTSEC
Ethernet
MII
0.01
W
Multiply with
number of the
interfaces
GMII/TBI
0.07
W
RGMII/RTBI
0.04
W
eTSEC
FIFO I/O
16b, 200 MHz
0.20
W
Multiply with
number of the
interfaces
16b, 155 MHz
0.16
W
8b, 200 MHz
0.11
W
8b, 155 MHz
0.08
W
QE UCC
MII/RMII
0.01
W
Multiply with
number of the
interfaces
If UCC is
programmed
for other
protocols,
scale Ethernet
power
dissipation to
the number of
signals and the
clock rate
GMII/TBI
0.07
W
RGMII/RTBI
0.04
W
Note: This is the power for each individual interface. The power must be calculated for each interface being utilized.
Table 7. SYSCLK AC Timing Specifications
At recommended operating conditions (see Table 3) with OVDD = 3.3 V ± 165 mV.
Parameter/Condition
Symbol
Min
Typical
Max
Unit
Notes
SYSCLK frequency
fSYSCLK
—
166
MHz
1
SYSCLK cycle time
tSYSCLK
6.0
—
ns
—
SYSCLK rise and fall time
tKH, tKL
0.61.0
2.3ns
2
SYSCLK duty cycle
tKHK/tSYSCLK
40
—
60
%
3
Table 6. Typical MPC8568E I/O Power Dissipation (continued)
Interface
Parameters
GVDD
BVDD
OVDD
LVDD
TVDD
XVDD Unit
Comment
2.5 V
1.8 V 3.3 V 2.5 V
3.3 V
2.5 V
3.3 V
2.5 V
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PDF描述
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MPC8569ECVTANKGB 功能描述:數(shù)字信號處理器和控制器 - DSP, DSC 8569E XT 800/600/400 r2.1 RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時器數(shù)量:3 設(shè)備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風(fēng)格:SMD/SMT
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