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參數(shù)資料
| 型號： | MT90503 |
| 廠商： | Zarlink Semiconductor Inc. |
| 英文描述： | 2048VC AAL1 SAR |
| 中文描述： | 2048VC AAL1特區(qū) |
| 文件頁數(shù)： | 34/233頁 |
| 文件大?。?/td> | 1341K |
| 代理商： | MT90503 |
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MT90503
Data Sheet
34
Zarlink Semiconductor Inc.
Figure 5 - PLL Pin Connections
4.0 Functional Description
1
4.1 CPU Interface
The MT90503 CPU module provides an interface permitting programmability from an external microprocessor. The
CPU module permits read/write access from MT90503: internal registers, internal and external memories.
The CPU interface comprises of:
Direct Access Select (DAS) as the MSB bit concatenated with a 15-bit address bus
16-bit data bus
2 interrupt signals
associated control signals
little endian format, unless otherwise specified
The CPU interface can be configured to operate with either Intel or Motorola CPUs. The MT90503 supports both
8-bit or 16-bit data bus and multiplexed or non-multiplexed address/data pins. If the CPU is operating in 15-bit byte
mode addressing with the LSB of its address bus as a byte field, then the inmo_a [14:0] pins of the MT90503 can
be connected to the a[15:1] pins of the CPU. If both the MT90503 and the CPU are in 15-bit word mode addressing,
then the inmo_a[14:0] pins should be connected to the a[14:0] pins of the CPU.
A reduced set of registers ‘CPU Interface Registers’ (0000h to 000Ah) are employed to optimize access time and to
permit the CPU to execute indirect read/write accesses via these registers. The CPU also engages these registers
to perform direct read/write accesses. The MT90503 and CPU timing relationship is described in section 9.1 on
page 211.
The CPU Control Register (0100h) provides a software reset capability that allows the CPU to reset the MT90503
except for the CPU interface. The CPU interface can only be reset by a hardware reset.
1. This product incorporates technology licensed from Melita International Corporation.
pllvdd_0
pllvss_0
pllvdd_1
pllvss_1
pllp2
pllagn
100pF
0.001uF
10uF
VDD
100pF
0.001uF
10uF
VDD
301 ohm (1%)
0.01uF (5%)
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MT90503AG | CLIP, STRAIN RELIEF, 50WAY; For use with:820 Series Tripolarized Wiremount Sockets; Ways, No. of:50; Material:Metal; Connector type:Strain Relief RoHS Compliant: Yes |
| MT90520 | 8-Port Primary Rate Circuit Emulation AAL1 SAR |
| MT90520AG | 8-Port Primary Rate Circuit Emulation AAL1 SAR |
| MT9072 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| MT9072AB | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MT90503AG | 制造商:Microsemi Corporation 功能描述: |
| MT90520 | 制造商:ZARLINK 制造商全稱:Zarlink Semiconductor Inc 功能描述:8-Port Primary Rate Circuit Emulation AAL1 SAR |
| MT90520AG | 制造商:Microsemi Corporation 功能描述:ATM SAR 2.048MBPS 2.5V CBR 456BGA - Trays |
| MT90520AG2 | 制造商:Microsemi Corporation 功能描述:ATM SAR 2.048MBPS 2.5V CBR 456BGA - Trays 制造商:Zarlink Semiconductor Inc 功能描述:ATM SAR 2.048MBPS 2.5V CBR 456BGA - Trays |
| MT90528 | 制造商:ZARLINK 制造商全稱:Zarlink Semiconductor Inc 功能描述:28-Port Primary Rate Circuit Emulation AAL1 SAR |
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