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參數(shù)資料
| 型號： | MT90503 |
| 廠商： | Zarlink Semiconductor Inc. |
| 英文描述： | 2048VC AAL1 SAR |
| 中文描述： | 2048VC AAL1特區(qū) |
| 文件頁數(shù)： | 65/233頁 |
| 文件大?。?/td> | 1341K |
| 代理商： | MT90503 |
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MT90503
Data Sheet
65
Zarlink Semiconductor Inc.
4.3.5.1 TX_SAR Control Structure Fields
Figure 29 - TX_SAR Control Structure shows the TX_SAR control structure format and data fields held in control
memory. Table 22, Description of the Fields for the TX_SAR Control Structure describes the data fields.
The header for the ATM cell to be constructed is derived from words +8 and +A in the TX_SAR control structure.
The final 8 bits of the cell header, the Header Error Check (HEC), are calculated and inserted by the UTOPIA
module. The channel entries, beginning at +16h, are 14-bit pointers to the circular buffers in external data memory,
one for each channel in the VC.
Figure 29 - TX_SAR Control Structure
Field
Name of
Field
Byte
Address
Offset /Bits
Used
Description of Field
First Entry
First Entry
+0/b15:b12
First entry gives the position within the structure of the pointer
to the first channel. The field is a word pointer and is constant
with a value of 0xB. To allow for future structure updates, its
value is programmable.
Channel 0’s address is located at base_add + (2 * First Entry).
A
Structure
Active
+0/b11
This bit indicates whether or not the VC is active. The control
structure becomes active when A is set. The A bit is set by
software. If the A bit is reset, the control structure will always
be ignored. If the A bit is set, hardware may ignore it for other
reasons, such as the control structure not being initialised.
Table 22 - Description of the Fields for the TX_SAR Control Structure
First Entry
A
SRTS
AAL
CE
BS
Last Entry
TXD
Payload Size
Offset
GFC
VPI
VCI [15:12]
VCI [11:0]
OAM
CLP
P-Byte Counter
Current Entry
I
Seq
tx_sar_read_pnt
Transmitted Cell Counter [31:16]
Transmitted Cell Counter [15:0]
Channel 0’s TX/RX Circular Buffer Pointer
Channel 1’s TX/RX Circular Buffer Pointer
Channel (n-2)’s TX/RX Circular Buffer Pointer
Channel (n-1)’s TX/RX Circular Buffer Pointer
Reserved
n=number of
TDM Channels
in the VC
Hardware Write
Back Fields
b15 b14 b13 b12 b11b10 b9 b8 b7 b6 b5 b4 b3 b2 b1 b0
+ 0h
+ 2h
+ 4h
+ 6h
+ 8h
+ Ah
+ Ch
+ Eh
+ 10h
+ 12h
+ 14h
+ 16h
+ 18h
+(n*2) + 14h
+ (n*2) + 16h
Header Fields
PTI
V
V
V
V
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MT90503AG | CLIP, STRAIN RELIEF, 50WAY; For use with:820 Series Tripolarized Wiremount Sockets; Ways, No. of:50; Material:Metal; Connector type:Strain Relief RoHS Compliant: Yes |
| MT90520 | 8-Port Primary Rate Circuit Emulation AAL1 SAR |
| MT90520AG | 8-Port Primary Rate Circuit Emulation AAL1 SAR |
| MT9072 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| MT9072AB | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MT90503AG | 制造商:Microsemi Corporation 功能描述: |
| MT90520 | 制造商:ZARLINK 制造商全稱:Zarlink Semiconductor Inc 功能描述:8-Port Primary Rate Circuit Emulation AAL1 SAR |
| MT90520AG | 制造商:Microsemi Corporation 功能描述:ATM SAR 2.048MBPS 2.5V CBR 456BGA - Trays |
| MT90520AG2 | 制造商:Microsemi Corporation 功能描述:ATM SAR 2.048MBPS 2.5V CBR 456BGA - Trays 制造商:Zarlink Semiconductor Inc 功能描述:ATM SAR 2.048MBPS 2.5V CBR 456BGA - Trays |
| MT90528 | 制造商:ZARLINK 制造商全稱:Zarlink Semiconductor Inc 功能描述:28-Port Primary Rate Circuit Emulation AAL1 SAR |
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