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參數(shù)資料
| 型號： | P32P4910 |
| 廠商： | NXP Semiconductors N.V. |
| 英文描述： | PRML Read Channel with PR4, 8/9 ENDEC, 4-Burst Servo |
| 中文描述： | PRML讀取通道與PR4，8 / 9 ENDEC，4突發(fā)伺服 |
| 文件頁數(shù)： | 23/196頁 |
| 文件大?。?/td> | 1056K |
| 代理商： | P32P4910 |
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General Description
Functional Pin Description
MC68HC(7)05H12
—
Rev. 1.0
General Release Specification
MOTOROLA
General Description
21
L
G
R
1.6 Functional Pin Description
The following paragraphs give a description of the general function of
each pin.
1.6.1 VDD and VSS
Power is supplied to the MCU through VDD and VSS. VDD is the
positive supply, and VSS is ground.
1.6.2 AVDD
AVDD is a separate supply pin providing power to the A/D converter.
1.6.3 OSC1, OSC2
The OSC1 and OSC2 pins are the connections for the on-chip oscillator.
A crystal connected across these pins or an external signal connected
to OSC1 provides the oscillator clock. The frequency, f
OSC
, of the
oscillator or external clock source is divided by two or eight (slow mode)
to produce the internal operating frequency, f
OP
.
1.6.4 RESET
This pin can be used as an input to reset the MCU to a known start-up
state by pulling it to the low state. The RESET pin contains an internal
Schmitt trigger to improve its noise immunity as an input. The RESET pin
has an internal pulldown device that pulls the RESET pin low when there
is an internal COP watchdog reset, power-on reset (POR), illegal
address reset, or an internal low voltage reset. Refer to
Section 5 Resets
. The RESET pin contains an internal pullup device.
1.6.5 IRQ/VPP
The interrupt triggering sensitivity of this pin can be programmed as
falling edge sensitive or falling edge and low level sensitive.The IRQ pin
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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