參數(shù)資料
型號(hào)： PCI7610LQFP
廠商： Texas Instruments, Inc.
英文描述： PC Card, UltraMedia, and Integrated 1394a-2000 OHCI Two-Port PHY/Link-Layer Controller
中文描述： PC卡，UltraMedia和集成1394 - 2000 OHCI的雙端口的PHY /鏈路層控制器
文件頁(yè)數(shù)： 97/240頁(yè)
文件大?。?/td> 1298K
代理商： PCI7610LQFP
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421
4.32 General Control Register
The general control register provides top level PCI arbitration control. See Table 49 for a complete description of
the register contents.
Bit
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
Name
General control
Type
R
R
R
R
R
R
RW
RW
R
R
RW
RW
RW
R
RW
RW
Default
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
Register:
Offset:
Type:
Default:
General control
86h
Read/Write, Read-only
0000h
Table 49. General Control Register Description
BIT
SIGNAL
TYPE
FUNCTION
1513
RSVD
RW
These bits are for test purposes and must not be changed from their default values of 000b.
12
IO_LIMIT_SEL
RW
When this bit is set, bit 0 in the I/O limit registers (PCI offsets 30h and 38h) for both CardBus functions
is set.
0 = Bit 0 in the I/O limit registers is 0 (default)
1 = Bit 0 in the I/O limit registers is 1
11
IO_BASE_SEL
RW
When this bit is set, bit 0 in the I/O base registers (PCI offsets 2Ch and 34h) for both CardBus functions
is set.
0 = Bit 0 in the I/O base registers is 0 (default)
1 = Bit 0 in the I/O base registers is 1
10
12V_SW_SEL
RW
Power switch select. This bit selects which power switch is implemented in the system.
0 = A 1.8-V capable power switch (TPS2221) is used (default)
1 = A 12-V capable power switch (TPS2211) is used
98
RSVD
R
Reserved. These bits return 0 when read.
7
PCI2_3_EN
RW
PCI 2.3 enable. When this bit is set, the PCI7610 CardBus functions conform to the PCI 2.3
specification. When in the PCI 2.3 mode, the INT_DISABLE and INT_STATUS bits per the PCI 2.3
specification are functional. When this bit is cleared, the function conforms to the PCI 2.2 specification
and all PCI 2.3 bits are disabled.
0 = PCI 2.2 mode (default)
1 = PCI 2.3 mode
6
RSVD
R
Reserved. This bit returns 0 when read.
5
DISABLE_FWL
RW
When this bit is set, the firmware loader function is completely nonaccessible and nonfunctional.
4
DISABLE_DED_
SKT
RW
When this bit is set, the dedicated socket function is completely nonaccessible and nonfunctional.
3
DISABLE_OHCI
RW
When set, the OHCI 1394 controller function is completely nonaccessible and nonfunctional.
2
RSVD
R
Reserved. This bit returns 0 when read.
10
ARB_CTRL
RW
Controls top level PCI arbitration:
00 = 1394 OHCI priority
01 = CardBus priority
10 = Fair round robin
11 = Fair round robin
One or more bits in this register are cleared only by the assertion of GRST.
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