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參數(shù)資料
| 型號： | PEF2080 |
| 廠商： | SIEMENS AG |
| 英文描述： | S/T Bus Interface Circuit(SBC) |
| 中文描述： | S / T的總線接口電路（SBC）的 |
| 文件頁數(shù)： | 43/74頁 |
| 文件大?。?/td> | 2620K |
| 代理商： | PEF2080 |
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Semiconductor Group
44
Operational Description
Unconditional States
Loop3 closed
On Activate Request Loop command, INFO3 is sent by the line transmitter internally to the line
receiver (INFO0 is transmitted to the line). The receiver is not yet synchronized.
Loop3 activated
The receiver is synchronized on INFO3 which is looped back internally from the transmitter. Data
may be sent. The indication “Tl” or”ATI” is output depending whether or not a signal different from
INFO0 is detected on the S interface.
Test mode continuous pulses
Continuous alternating pulses are sent.
Test mode single pulses
Single alternating pulses are sent (2-kHz repetition rate).
Reset state
A software reset (RS) forces the SBC to an idle state where the analog components are disabled
(transmission of INFO0) and the S line awake detector is inactive. Thus activation from the NT is
not possible. Clocks are still supplied (TE mode) and the outputs are in a low impedance state.
相關(guān)PDF資料 |
PDF描述 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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