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參數(shù)資料
| 型號： | PM7366-BI |
| 廠商： | PMC-SIERRA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | TVS BI-DIR 30V 1500W DO-201 |
| 中文描述： | 8 CHANNEL(S), 64K bps, SERIAL COMM CONTROLLER, PBGA256 |
| 封裝： | 27 X 27 MM, 1.45 MM HEIGHT, SBGA-256 |
| 文件頁數(shù)： | 201/286頁 |
| 文件大?。?/td> | 2243K |
| 代理商： | PM7366-BI |
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RELEASED
DATA SHEET
PM7366 FREEDM-8
ISSUE 4
PMC-1970930
FRAME ENGINE AND DATA LINK MANAGER
PROPRIETARY AND CONFIDENTIAL TO PMC-SIERRA,INC., AND FOR ITS CUSTOMERS’ INTERNAL USE
188
of 16 byte blocks, less one, that is transferred in each DMA transaction. Thus, the minimum
number of blocks is one (16 bytes) and the maximum is eight (128 bytes).
BURSTEN:
The burst length enable bit (BURSTEN) controls the use of BURST[2:0] in determining the
amount of data requested in a single DMA transaction for channels whose channel transfer
size is set to one block (XFER[2:0] = 'b000). BURSTEN has no effect on channels configured
with other transfer sizes. When BURSTEN is set high, the maximum size of DMA transfer is
limited by BURST[2:0]. The transmit HDLC processor may combine several channel transfer
size amounts into a single transaction. When BURSTEN is set low, the amount of data in a
DMA transfer is limited to one block.
TSTD:
The telecom standard bit (TSTD) controls the bit ordering of the HDLC data transferred from
the PCI host. When TSTD is set low, the least significant bit of the each byte on the PCI bus
(AD[0], AD[8], AD[16] and AD[24]) is the first HDLC bit transmitted and the most significant bit
of each byte (AD[7], AD[15], AD[23] and AD[31]) is the last HDLC bit transmitted (datacom
standard). When TSTD is set high, AD[0], AD[8], AD[16] and AD[24] are the last HDLC bit
transmitted and AD[7], AD[15], AD[23] and AD[31] are the first HDLC bit transmitted (telecom
standard).
BIT8:
The least significant stuff control bit (BIT8) carries the value placed in the least significant bit
of each octet when the HDLC processor is configured (7BIT set high) to stuff the least
significant bit of each octet in the corresponding transmit link (TD[n]). When BIT8 is set high,
the least significant bit (last bit of each octet transmitted) is forced high. When BIT8 is set
low, the least significant bit is forced low. BIT8 is ignored when 7BIT is set low.
相關PDF資料 |
PDF描述 |
|---|---|
| PM7366-PI | FRAME ENGINE AND DATA LINK MANAGER |
| PM7367-PI | DIODE 1N4002 RECTIFYING |
| PM7367 | 32 link, 32 Channel Data Link Manager with PCI Interface |
| PM7375 | ATM SAR and PHY Processor for PCI Bus |
| PM7375-SC | LOCAL ATM SAR & PHYSICAL LAYER |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| PM7366-PI | 制造商:PMC-Sierra 功能描述: |
| PM7367 | 制造商:PMC 制造商全稱:PMC 功能描述:FRAME ENGINE AND DATA LINK MANAGER |
| PM7367-PI | 制造商:PMC 制造商全稱:PMC 功能描述:FRAME ENGINE AND DATA LINK MANAGER |
| PM-737 | 制造商:Eclipse Tools 功能描述: |
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