參數(shù)資料
型號(hào)： PM7366-BI
廠商： PMC-SIERRA INC
元件分類(lèi)： 微控制器/微處理器
英文描述： TVS BI-DIR 30V 1500W DO-201
中文描述： 8 CHANNEL(S), 64K bps, SERIAL COMM CONTROLLER, PBGA256
封裝： 27 X 27 MM, 1.45 MM HEIGHT, SBGA-256
文件頁(yè)數(shù)： 93/286頁(yè)
文件大?。?/td> 2243K
代理商： PM7366-BI
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RELEASED
DATA SHEET
PM7366 FREEDM-8
ISSUE 4
PMC-1970930
FRAME ENGINE AND DATA LINK MANAGER
PROPRIETARY AND CONFIDENTIAL TO PMC-SIERRA,INC., AND FOR ITS CUSTOMERS’ INTERNAL USE
80
However, the SERRI bit remains valid when interrupts are disabled and may be polled to
detect PCI system error events.
PERRE:
The parity error interrupt enable bit (PERRE) enables PCI parity error interrupts to the PCI
host. When PERRE is set high, data parity errors detected by the FREEDM-8 or parity errors
reported by a target will cause an interrupt to be generated on the PCIINTB output. Interrupts
are masked when PERRE is set low. However, the PERRI bit remains valid when interrupts
are disabled and may be polled to detect PCI parity error events.
RFCSEE:
The receive frame check sequence error interrupt enable bit (RFCSEE) enables receive FCS
error interrupts to the PCI host. When RFCSEE is set high, a mismatch between the received
FCS code and the computed CRC residue will cause an interrupt to be generated on the
PCIINTB output. Interrupts are masked when RFCSEE is set low. However, the RFCSEI bit
remains valid when interrupts are disabled and may be polled to detect receive FCS error
events.
RABRTE:
The receive abort interrupt enable bit (RABRTE) enables receive HDLC abort interrupts to the
PCI host. When RABRTE is set high, receipt of an abort code (at least 7 contiguous 1's) will
cause an interrupt to be generated on the PCIINTB output. Interrupts are masked when
RABRTE is set low. However, the RABRTI bit remains valid when interrupts are disabled and
may be polled to detect receive abort events.
RPFEE:
The receive packet format error interrupt enable bit (RPFEE) enables receive packet format
error interrupts to the PCI host. When RPFEE is set high, receipt of a packet that is longer
than the maximum specified in the RHDL Maximum Packet Length register, of a packet that is
shorter than 32 bits (CRC-CCITT) or 48 bits (CRC-32), or of a packet that is not octet aligned
will cause an interrupt to be generated on the PCIINTB output. Interrupts are masked when
RPFEE is set low. However, the RPFEI bit remains valid when interrupts are disabled and
may be polled to detect receive packet format error events.
RFOVRE:
The receive FIFO overrun error interrupt enable bit (RFOVRE) enables receive FIFO overrun
error interrupts to the PCI host. When RFOVRE is set high, attempts to write data into the
logical FIFO of a channel when it is already full will cause an interrupt to be generated on the
PCIINTB output. Interrupts are masked when RFOVRE is set low. However, the RFOVRI bit
remains valid when interrupts are disabled and may be polled to detect receive FIFO overrun
events.
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PDF描述
PM7366-PI FRAME ENGINE AND DATA LINK MANAGER
PM7367-PI DIODE 1N4002 RECTIFYING
PM7367 32 link, 32 Channel Data Link Manager with PCI Interface
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參數(shù)描述
PM7366-PI 制造商:PMC-Sierra 功能描述:
PM7367 制造商:PMC 制造商全稱(chēng):PMC 功能描述:FRAME ENGINE AND DATA LINK MANAGER
PM7367-PI 制造商:PMC 制造商全稱(chēng):PMC 功能描述:FRAME ENGINE AND DATA LINK MANAGER
PM-737 制造商:Eclipse Tools 功能描述:
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