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參數(shù)資料
| 型號： | PXB4330 |
| 廠商： | INFINEON TECHNOLOGIES AG |
| 英文描述： | ICs for Communications |
| 中文描述： | 通信集成電路 |
| 文件頁數(shù)： | 149/201頁 |
| 文件大?。?/td> | 2362K |
| 代理商： | PXB4330 |
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PXB 4330
Register Descriptions
Data Sheet
6-149
09.99
Register 46
ISRU
Interrupt Status Register Upstream
CPU Accessibility:
Reset Value:
Offset Address:
Typical Usage:
Read/Write
0000
H
ISRU
Read by CPU to evaluate interrupt events related to the
upstream core. Interrupt indications must be cleared by writing
a 1 to the respective bit locations; writing a 0 has no effect;
D0
H
Bit
15
14
13
12
11
LCI
INVAL
10
9
8
Unused
RAMER
QIDINV
BUFER
1
PARITY
ER
SOCER
BUFER
2
Bit
7
6
5
4
3
2
1
0
BUFER
3
CDVOV
MUXOV
BUFER4/
CNTUF
RMCER
BIP8ER
BUFER
5
VCRM
ER
RAMER
Configuration of common Cell Pointer RAM has been changed after
cells have been received (see Register
MODE
, bit field CPR).
(This is a global interrupt shared by both cores. That is, it is not
exclusively related to the Upstream Core.)
QIDINV
This interrupt is generated if the ABM tries to write a cell into a
disabled queue. The cell is discarded in this case.
(Typically occurs on queue configuration errors.)
BUFER1
Unexpected buffer error number 1. Should never occur in normal
operation. Immediate reset of the chip recommended.
LCIINVAL
Cell with invalid LCI received, that is, a LCI value > 8191.
The cell is discarded.
PARITYER
Parity error at UTOPIA receive upstream (PHY) Interface detected.
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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| PXB4340E | 制造商:INFINEON 制造商全稱:Infineon Technologies AG 功能描述:ICs for Communications |
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