參數(shù)資料
型號： SL28EB717ALIT
廠商： Silicon Laboratories Inc
文件頁數(shù)： 5/22頁
文件大?。?/td> 0K
描述： IC CLK CK505 TNLCRK/TOPCLF 48QFN
標(biāo)準(zhǔn)包裝： 2,500
系列： EProClock®
類型： 時鐘/頻率發(fā)生器，多路復(fù)用器
PLL： 是
主要目的： Intel CPU 服務(wù)器
輸入： 時鐘，晶體
輸出： HCSL，LVCMOS
電路數(shù)： 1
比率 - 輸入:輸出： 1:13
差分 - 輸入:輸出： 無/是
頻率 - 最大： 166.67MHz
電源電壓： 3.135 V ~ 3.465 V
工作溫度： -40°C ~ 85°C
安裝類型： *
封裝/外殼： *
供應(yīng)商設(shè)備封裝： *
包裝： *
SL28EB717
DOC#: SP-AP-0755 (Rev. AA)
Page 13 of 22
PCI/SRC_STP# Deassertion
The deassertion of the PCI/SRC_STP# signal causes all PCI
and stoppable PCIF to resume running in a synchronous
manner within two PCI clock periods, after PCI/SRC_STP#
transitions to a HIGH level. Simlarly, PCI/SRC_STP#
deassertion will cause stoppable SRC clocks to resume
running. For SRC clocks deassertion description, please refer
to CPU_STP# description.
.
PC I_ STP#
PC I_ F
PC I
S RC 100 M H z
Tsu
Td rive _ S R C
Figure 7. PCI_STP# Deassertion Waveform
FSC
FSB
FSA
Off
Latches Open
M1
T_delay3
Off
3.3V
T_delay t
C l o c k O ff to M 1
CPU_STP#
PCI_STP#
Vcc
CKPWRGD/PD#
CK505 SMBUS
CK505 State
BSEL[0..2]
CK505 Core Logic
PLL1
CPU1
PLL2 & PLL3
All Other Clocks
REF Oscillator
T_delay2
Locked
2.0V
Figure 8. BSEL Serial Latching
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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SL28EB719AZIT 功能描述:時鐘發(fā)生器及支持產(chǎn)品 Tunnel Creek Queen’s Bay platform RoHS:否 制造商:Silicon Labs 類型:Clock Generators 最大輸入頻率:14.318 MHz 最大輸出頻率:166 MHz 輸出端數(shù)量:16 占空比 - 最大:55 % 工作電源電壓:3.3 V 工作電源電流:1 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:QFN-56
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