參數(shù)資料
型號(hào)： TMS320C6421_0711
廠商： Texas Instruments, Inc.
元件分類： 數(shù)字信號(hào)處理
英文描述： Fixed-Point Digital Signal Processor
中文描述： 定點(diǎn)數(shù)字信號(hào)處理器
文件頁數(shù)： 84/223頁
文件大小： 1658K
代理商： TMS320C6421_0711
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www.ti.com
3.7 Multiplexed Pin Configurations
TMS320C6421
Fixed-Point Digital Signal Processor
SPRS346C–JANUARY 2007–REVISED NOVEMBER 2007
C6421 makes extensive use of pin multiplexing to accommodate a large number of peripheral functions in
the smallest possible package, providing ultimate flexibility for end applications.
The Pin Multiplex Registers PINMUX0 and PINMUX1 in the System Module are responsible for controlling
all pin multiplexing functions on the C6421. The default setting of some of the PINMUX0 and PINMUX1 bit
fields are configured by configuration pins latched at reset (see
Section 3.5.1
,
Device and Peripheral
Configurations at Device Reset
). After reset, software may program the PINMUX0 and PINMUX1 registers
to switch pin functionalities.
The following peripherals have multiplexed pins: EMIFA, HPI, VLYNQ, EMAC, McASP0, McBSP0, PWM0,
PWM1, PWM2, Timer0, Timer1, UART0, and GPIO.
The device is divided into the following Pin Multiplexed Blocks (Pin Mux Blocks):
EMIFA Block:
EMIFA and GPIO. This block is further subdivided into these sub-blocks:
–
Sub-Block 0:
part of EMIFA (address and control), part of EMAC(RMII), and GPIO
–
Sub-Block 1:
part of EMIFA (data, address, control), part of EMAC(RMII), and GPIO
–
Sub-Block 2:
part of EMIFA (control signals EM_WAIT/(RDY/BSY), EM_OE, and EM_WE)
–
Sub-Block 3:
part of EMIFA (address EM_A[12:5]) and GPIO
Host Block:
HPI, VLYNQ, EMAC(MII), and GPIO
Serial Port Block:
McBSP0, McASP0, and GPIO. This block is further sub-divided into sub-blocks.
–
Serial Port Sub-Block 0:
McBSP0, part of McASP0, and GPIO
–
Serial Port Sub-Block 1:
part of McASP0 and GPIO
UART0 Flow Control Block:
UART0 flow control, PWM0, and GPIO
UART0 Data Block:
UART0 data and GPIO
Timer0 Block:
Timer0 and McBSP0 CLKS pins
Timer1 Block:
Timer1 and GPIO
PWM1 Block:
PWM1 and GPIO
CLKOUT Block:
CLKOUT0, PWM2, and GPIO
As shown in the list above, the McBSP0, UART0, and EMAC peripherals span multiple Pin Mux Blocks.
To use these peripherals, they must be selected in all relevant Pin Mux Blocks. For more details, see
Section 3.7.3
,
Pin Multiplexing Details
, and
Section 3.7.3.2
,
Peripherals Spanning Multiple Pin Mux
Blocks
.
Note:
There is no actual pin multiplexing in EMIFA Sub-Block 2. However it is still considered a "pin mux
block" because it contains part of the pins necessary for EMIFA.
A high level view of the Pin Mux Blocks is shown in
Figure 3-10
. In each Pin Mux Block, the
PINMUX0/PINMUX1 default settings are underlined.
Note:
Some default pin functions are determined by configuration pins (AEM[2:0]); therefore, more than
one configuration setting can serve as default based on the configuration pin settings latched at device
reset.
Device Configurations
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