參數(shù)資料
型號： TMS320C6421_0711
廠商： Texas Instruments, Inc.
元件分類： 數(shù)字信號處理
英文描述： Fixed-Point Digital Signal Processor
中文描述： 定點數(shù)字信號處理器
文件頁數(shù)： 90/223頁
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代理商： TMS320C6421_0711
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www.ti.com
TMS320C6421
Fixed-Point Digital Signal Processor
SPRS346C–JANUARY 2007–REVISED NOVEMBER 2007
Table 3-18. PINMUX1 Register Description (continued)
Bit
Field Name
Description
Pins Controlled
PWM1 Block Pin Select.
Selects the function of the multiplexed pins in the PWM1 Block.
0 = GPIO Mode (
default
).
Pin functions as GPIO (GP[4]).
PWM1 Block:
GP[4]/PWM1
12
PWM1BK
1 = PWM1 Mode.
Pin functions as PWM1.
UART0 Flow Control Block Pin Select.
Selects the function of the multiplexed pins in the UART0 Flow Control Block.
00 = GPIO Mode (
default
).
Pins function as GPIO (GP[88:87]).
UART0 Flow Control Block:
UCTS0/GP[87]
URTS0/PWM0/GP[88]
11:10
UR0FCBK
01 = UART0 Flow Control Mode.
Pins function as UART0 Flow Control UCTS0 and URTS0.
10 = PWM0 + GPIO Mode.
Pins function as PWM0 and GPIO (GP[87]).
11 = Reserved
Reserved. For proper device operation, the user should only write "0" to this bit
(
default
).
9
RSV
–
UART0 Data Block Pin Select.
Selects the function of the multiplexed pins in the UART0 Data Block.
UART0 Data Block:
URXD0/GP[85]
UTXD0/GP[86]
0 = GPIO Mode (
default
).
Pins function as GPIO (GP[86:85]).
8
UR0DBK
1 = UART0 Data Mode.
Pins function as UART0 data URXD0 and UTXD0.
Reserved. For proper device operation, the user should only write "0" to this bit
(
default
).
7
RSV
–
Host Block:
VLYNQ_CLOCK/GP[57]
HD0/VLYNQ_SCRUN/GP[58]
HD1/VLYNQ_RXD0/GP[59]
HD2/VLYNQ_RXD1/GP[60]
HD3/VLYNQ_RXD2/GP[61]
HD4/VLYNQ_RXD3/GP[62]
HD5/VLYNQ_TXD0/GP[63]
HD6/VLYNQ_TXD1/GP[64]
HD7/VLYNQ_TXD2/GP[65]
HD8/VLYNQ_TXD3/GP[66]
HD9/MCOL/GP[67]
HD10/MCRS/GP[68]
HD11/MTXD3/GP[69]
HD12/MTXD2/GP[70]
HD13/MTXD1/GP[71]
HD14/MTXD0/GP[72]
HD15/MTXCLK/GP[73]
HHWIL/MRXDV/GP[74]
HCNTL1/MTXEN/GP[75]
HCNTL0/MRXER/GP[76]
HR/W/MRXCLK/GP[77]
HDS2/MRXD0/GP[78]
HDS1/MRXD1/GP[79]
HRDY/MRXD2/GP[80]
HCS/MDCLK/GP[81]
HINT/MRXD3/GP[82]
HAS/MDIO/GP[83]
Host Block Pin Select.
If EMAC opertaion is desired, EMAC must be placed in reset before
programminng PINMUX1. HOSTBK or PINMUX0.RMII to select EMAC pins.
HOSTBK = 000: GPIO Mode
Pins function as GPIO (GP[83:57]).
HOSTBK = 001: HPI + 1 GPIO Mode.
Pins function as HPI and GPIO (GP[57]).
HOSTBK = 010: VLYNQ + 17 GPIO Mode.
Pins function as VLYNQ (VLYNQ_CLOCK, VLYNQ_SCRUN, VLYNQ_RXD[3:0],
VLYNQ_TXD[3:0]), and GP[83:67].
6:4
HOSTBK
HOSTBK = 011: VLYNQ + MII + MDIO Mode.
Pins function as VLYNQ (VLYNQ_CLOCK, VLYNQ_SCRUN, VLYNQ_RXD[3:0],
VLYNQ_TXD[3:0]), MII (TXCLK, CRS, COL, TXD[3:0], RXVD, TXEN, RXER,
RXCLK, RXD[3:0]), and MDIO (MDIO, MDC).
When EMAC(MII) is selected, EMAC(RMII) must not be selected.
PINMUX0.RMII must be set to 0.
HOSTBK = 100: MII + MDIO +10 GPIO Mode.
Pins function as MII (TXCLK, CRS, COL, TXD[3:0], RXVD, TXEN, RXER,
RXCLK, RXD[3:0]), MDIO (MDIO, MDC), and GP[66:57].
When EMAC(MII) is selected, EMAC(RMII) must not be selected.
PINMUX0.RMII must be set to 0.
All other HOSTBK combinations reserved.
The HOSTBK field selects the function of these
27 pins.
Reserved. For proper device operation, the user should only write "0" to this bit
(
default
).
3:1
RESERVED
–
0
RSV
Reserved. Writes have no effect.
–
Device Configurations
90
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相關PDF資料
PDF描述
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