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April 1999 Revised October 2008
SPRS082F
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TMS320VC5409 Features
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2
Introduction
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2.1
Pin Assignments
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2.2
GGU Package Layout and Pin Assignments
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2.3
PGE Package Layout and Pin Assignments
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2.4
Terminal Functions
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3
Functional Overview
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3.1
CPU Core
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3.1.1
Software Programmable WaitState Generator
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3.1.2
Programmable Bank-Switching Wait States
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3.1.3
CPU Memory-Mapped Registers
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3.2
Memory
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3.2.1
Memory Map
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3.2.2
On-Chip ROM With Bootloader
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3.2.3
On-Chip RAM
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3.2.4
On-Chip Memory Security
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3.2.5
Relocatable Interrupt Vector Table
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3.2.6
Extended Program Memory
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3.3
On-Chip Peripherals
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3.3.1
Parallel I/O Ports
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3.3.2
Multichannel Buffered Serial Ports (McBSPs)
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3.3.3
Hardware Timer
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3.3.4
Clock Generator
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3.3.5
DMA Controller
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3.3.6
Peripheral Memory-Mapped Registers
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3.4
Interrupts
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4
Documentation Support
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4.1
Device and Development Tool Support Nomenclature
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5
Electrical Specifications
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5.1
Absolute Maximum Ratings
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5.2
Recommended Operating Conditions
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5.3
Electrical Characteristics
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5.4
Internal Oscillator with External Crystal
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5.5
Divide-By-Two/Divide-By-Four Clock Option (PLL Disabled)
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5.6
Multiply-By-N Clock Option (PLL Enabled)
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5.7
Memory and Parallel I/O Interface Timing
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5.7.1
Memory Read
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5.7.2
Memory Write
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5.7.3
Parallel I/O Port Read
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5.7.4
Parallel I/O Port Write
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