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參數(shù)資料
| 型號： | UPD30102 |
| 廠商： | NEC Corp. |
| 英文描述： | 64/32-bit Microprocessor |
| 中文描述： | 64/32微處理器 |
| 文件頁數(shù)： | 171/701頁 |
| 文件大?。?/td> | 2329K |
| 代理商： | UPD30102 |
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CHAPTER 6 EXCEPTION PROCESSING
171
6.3.11 Cache Error Register (27)
The 32-bit read/write Cache Error (CacheErr) register processes parity errors in the on-chip cache. Parity errors
cannot be corrected by on-chip hardware.
The CacheErr register holds cache index and status bits that indicate the cause of the error.
In the V
R
4102, parity check is performed only for cache memory.
It is not performed for main memory or peripheral units.
Figure 6-12 shows the format of the CacheErr register.
Figure 6-12. CacheErr Register Format
31 30 29 28 27 26 25 24
11 10
0
14
11
ER
0
ED ET
0
EE EB
0
PIdx
1 1
1
1
1
1
1
ER : Reference type (0
o
Instruction, 1
o
Data)
ED : Indicates whether an error occurred in the data field (0
o
Normal, 1
o
Error).
ET : Indicates whether an error occurred in the tag field (0
o
Normal, 1
o
Error).
EE : This bit is set if an error occurs on the SysAD bus.
EB : This bit is set if a data error occurs subsequent to an instruction error. (The error status is indicated by
the remaining bit positions.) In this case, the data cache must be flushed upon the completion of
instruction error processing.
PIdx: Cache index
0
: Reserved for future use. Write 0 in a write operation. When this field is read, 0 is read.
6.3.12 ErrorEPC Register (30)
The Error Exception Program Counter (ErrorEPC) register is similar to the EPC register. It is used to store the
Program Counter value at which the Cache Error, Cold Reset, Soft Reset, or NMI exception has been serviced.
The read/write ErrorEPC register contains the virtual address at which instruction processing can resume after
servicing an error. This address can be:
—
the virtual address of the instruction that caused the error exception
—
the virtual address of the immediately preceding branch or jump instruction, when the instruction associated
with the error exception is in a branch delay slot.
The contents of the ErrorEPC register do not change when the ERL bit of the Status register is set to 1. This
prevents the processor when other exceptions occur from overwriting the address of the instruction in this register
which causes an error exception.
There is no branch delay slot indication for the ErrorEPC register.
Figure 6-13 shows the format of the ErrorEPC register.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| UPD30102GM-54-8EV | 64/32-bit Microprocessor |
| UPD30102GM-66-8EV | 64/32-bit Microprocessor |
| UPD30102S1-54-3C | 64/32-bit Microprocessor |
| UPD30102S1-66-3C | 64/32-bit Microprocessor |
| UPD30550F2-300-NN1 | VR5500⑩ 64-/32-BIT MICROPROCESSOR |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| UPD30102GM-54-8EV | 制造商:NEC 制造商全稱:NEC 功能描述:64/32-bit Microprocessor |
| UPD30102GM-66-8EV | 制造商:NEC 制造商全稱:NEC 功能描述:64/32-bit Microprocessor |
| UPD30102S1-54-3C | 制造商:NEC 制造商全稱:NEC 功能描述:64/32-bit Microprocessor |
| UPD30102S1-66-3C | 制造商:NEC 制造商全稱:NEC 功能描述:64/32-bit Microprocessor |
| UPD30111S1-70-3C | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:MICROPROCESSOR|32-BIT|CMOS|BGA|224PIN|PLASTIC |
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