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參數(shù)資料
| 型號： | UPD703213 |
| 廠商： | NEC Corp. |
| 英文描述： | 32-Bit Single-Chip Microcontrollers |
| 中文描述： | 32位單芯片微控制器 |
| 文件頁數(shù)： | 65/757頁 |
| 文件大?。?/td> | 4410K |
| 代理商： | UPD703213 |
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CHAPTER 2 PIN FUNCTIONS
User’s Manual U15862EJ3V0UD
65
Table 2-3. Pin Operation Status in Operation Modes of V850ES/KG1
Operating Status
Pin
Reset
Note 1
HALT Mode
IDLE Mode/
STOP Mode
Idle State
Note 2
Bus Hold
AD0 to AD15 (PDL0 to PDL15)
Hi-Z
Operating
Hi-Z
Held
Hi-Z
A0 to A15 (P90 to P915)
Hi-Z
Operating
Hi-Z
Held
Hi-Z
A16 to A21 (PDH0 to PDH5)
Hi-Z
Operating
Hi-Z
Held
Hi-Z
WAIT (PCM0)
Hi-Z
Operating
–
–
–
CLKOUT (PCM1)
Hi-Z
Operating
L
Operating
Operating
CS0, CS1 (PCS0, PCS1)
Hi-Z
Operating
H
Held
Hi-Z
WR0, WR1 (PCT0, PCT1)
Hi-Z
Operating
H
H
Hi-Z
RD (PCT4)
Hi-Z
Operating
H
H
Hi-Z
ASTB (PCT6)
Hi-Z
Operating
H
H
Hi-Z
HLDAK (PCM2)
Hi-Z
Operating
H
H
L
HLDRQ (PCM3)
Hi-Z
Operating
–
–
Operating
Notes 1.
Since the bus control pin is also used as a port pin, it is initialized to the port mode (input) after reset.
2.
The pin statuses in the idle state inserted after the T3 state in the multiplex mode and after the T2 state
in the separate mode are listed.
Remark
Hi-Z: High impedance
H:
High-level output
L:
Low-level output
–:
Input without sampling (input acknowledgement not possible)
Table 2-4. Pin Operation Status in Operation Modes of V850ES/KJ1
Operating Status
Pin
Reset
Note 1
HALT Mode
IDLE Mode/
STOP Mode
Idle State
Note 2
Bus Hold
AD0 to AD15 (PDL0 to PDL15)
Hi-Z
Operating
Hi-Z
Held
Hi-Z
A0 to A15 (P90 to P915)
Hi-Z
Operating
Hi-Z
Held
Hi-Z
A16 to A23 (PDH0 to PDH7)
Hi-Z
Operating
Hi-Z
Held
Hi-Z
WAIT (PCM0)
Hi-Z
Operating
–
–
–
CLKOUT (PCM1)
Hi-Z
Operating
L
Operating
Operating
CS0 to CS3 (PCS0 to PCS3)
Hi-Z
Operating
H
Held
Hi-Z
WR0, WR1 (PCT0, PCT1)
Hi-Z
Operating
H
H
Hi-Z
RD (PCT4)
Hi-Z
Operating
H
H
Hi-Z
ASTB (PCT6)
Hi-Z
Operating
H
H
Hi-Z
HLDAK (PCM2)
Hi-Z
Operating
H
H
L
HLDRQ (PCM3)
Hi-Z
Operating
–
–
Operating
Notes 1.
Since the bus control pin is also used as a port pin, it is initialized to the port mode (input) after reset.
2.
The pin statuses in the idle state inserted after the T3 state in the multiplex mode and after the T2 state
in the separate mode are listed.
Remark
Hi-Z: High impedance
H:
High-level output
L:
Low-level output
–:
Input without sampling (input acknowledgement not possible)
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