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參數(shù)資料
| 型號： | XRT72L52IQ |
| 廠商： | EXAR CORP |
| 元件分類： | 數(shù)字傳輸電路 |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | DATACOM, FRAMER, PQFP160 |
| 封裝： | 28 X 28 MM, PLASTIC, QFP-160 |
| 文件頁數(shù)： | 105/480頁 |
| 文件大?。?/td> | 2918K |
| 代理商： | XRT72L52IQ |
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xr
TWO CHANNEL DS3/E3 FRAMER IC WITH HDLC CONTROLLER
XRT72L52
REV. 1.0.1
89
2.3.5.6
Transmit DS3 M-Bit Mask Register
Bit 7 - 5:
TxFEBEDat[2:0]
These three (3) read/write bit-fields, along with Bit 4 of this register, allows the user to configure and transmit
his/her choice for the three (3) FEBE (Far-End Block Error) bits in each outgoing DS3 Frame. The user will
write his/her value for the FEBE bits into these bit-fields. The Transmit DS3 Framer block will insert these val-
ues into the FEBE bit-fields of each outgoing DS3 Frame, once the user has written a "1" to Bit 4 (FEBE Reg-
ister Enable).
N
OTE
:
For more information on this feature, refer to
Section 4.2.4.2.1.9
.
Bit 4 - FEBE Register Enable
This Read/Write bit-field permits the user to configure the Transmit DS3 Framer to insert the contents of
TxFEBEDat[2:0] into the FEBE bit-fields each outbound DS3 Frame.
Writing a "0" to this bit-field disables this feature (e.g., the Transmit DS3 Framer block will transmit the internal-
ly generated FEBE bits). Writing a "1" to this bit-field enables this features (e.g., the internally generated FEBE
bits are overwritten by the contents of the TxFEBEDat[2:0] bit-field).
N
OTE
:
For more information on this feature, refer to
Section 4.2.4.2.1.9
.
Bit 3 - Transmit Erred P-Bit
This Read/Write bit-field permits the user to insert errors into the P-bits within the outbound DS3 frames (via
the Transmit DS3/E3 Framer block). If the user enables this feature, then the Transmit DS3/E3 Framer block
will proceed to invert each and every P-bit, from its computed value, prior to transmission to the Remote Termi-
nal.
Writing a "0" to this bit-field (the default condition) disables this feature (e.g., the correct P-bits are sent). Writ-
ing a "1" to this bit-field enables this feature (e.g., the incorrect P-bits are sent).
N
OTE
:
For more information on this feature, refer to
Section 4.2.4.2.2
.
Bit 2 - 0 M-Bit Mask[2:0]
These Read/Write bit-fields permit the user to insert errors in the M-bits for Test and Diagnostic purposes. The
Transmit DS3/E3 Framer block automatically performs an XOR operation on the actual contents of the M-bit
fields to these register bit-fields. Therefore, for every '1' that exists in these bit-fields, will result in a change of
state of the corresponding M-bit, prior to being transmitted to the Remote Terminal Equipment.
If the Transmit DS3/E3 Framer block is to be operated in the normal mode (e.g., when no errors are being in-
jected into the M-bit fields of the outbound DS3 Frame), then these bit-fields must be all “0’s”.
2.3.5.7
Transmit DS3 F-Bit Mask Register 1
TXDS3 M-BIT MASK REGISTER (ADDRESS = 0X35)
B
IT
7
B
IT
6
B
IT
5
B
IT
4
B
IT
3
B
IT
2
B
IT
1
B
IT
0
TxFEBEDat[2:0]
FEBE Reg
Enable
Tx Error
P-Bit
MBit Mask[2]
MBit Mask[1]
MBit Mask[0]
R/W
R/W
R/W
R/W
R/W
R/W
R/W
R/W
0
0
0
0
0
0
0
0
TXDS3 F-BIT MASK REGISTER 1 (ADDRESS = 0X36)
B
IT
7
B
IT
6
B
IT
5
B
IT
4
B
IT
3
B
IT
2
B
IT
1
B
IT
0
Not Used
FBit Mask[27] FBit Mask[26] FBit Mask[25] FBit Mask[24]
RO
RO
RO
RO
R/W
R/W
R/W
R/W
0
0
0
0
0
0
0
0
相關PDF資料 |
PDF描述 |
|---|---|
| XRT72L52 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| XRT72L53 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| XRT72L54 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| XRT72L56IB | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| XRT72L56 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
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| XRT72L52IQTR-F | 功能描述:網(wǎng)絡控制器與處理器 IC RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
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