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參數(shù)資料
| 型號： | XRT72L52IQ |
| 廠商： | EXAR CORP |
| 元件分類： | 數(shù)字傳輸電路 |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | DATACOM, FRAMER, PQFP160 |
| 封裝： | 28 X 28 MM, PLASTIC, QFP-160 |
| 文件頁數(shù)： | 291/480頁 |
| 文件大?。?/td> | 2918K |
| 代理商： | XRT72L52IQ |
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xr
TWO CHANNEL DS3/E3 FRAMER IC WITH HDLC CONTROLLER
XRT72L52
REV. 1.0.1
275
The user can configure the LAPD Transmitter to interrupt the local Microprocessor/Microcontroller upon com-
pletion of transmission of the LAPD Message frame, by setting bit-field “1” (TxLAPD Interrupt Enable) within
the Tx E3 LAPD Status and Interrupt register (Address = 0x34). to “1” as depicted below.
)
‘The purpose of t his interrupt is to let the Microprocessor/Microcontroller know that the LAPD Transmitter is
available and ready to transmit a LAPD Message frame (which contains a new PMDL Message) to the remote
terminal equipment. Bit 0 (Tx LAPD Interrupt Status) within the Tx E3 LAPD Status and Interrupt Register will
reflect the status for the Transmit LAPD Interrupt.
N
OTE
:
This bit-field will be reset upon reading this register.
Summary of Operating the LAPD Transmitter
Once the user has invoked the TxDL Start command, the LAPD Transmitter will do the following.
Compute the 16 bit Frame Check Sum (FCS) of the LAPD Message Frame (e.g., of the LAPD Message
header and information payload) and append this value to the LAPD Message, (at the end of 76 or 82 bytes).
Append a trailer Flag Sequence octet to the end of the message LAPD following the 16 bit FCS value.
Serialize the composite LAPD message. Between the two 0x7E flags, ZeroStuff any consecutive five “Ones”
by inserting an extra “0”. This insures that any occurrence of 0x7E in the payload does not serve as a termi-
nating flag sequence. Insert the Zero Stuffed LAPD message into the N bit-field of each outgoing E3 Frame.
Complete the transmission of the frame overhead, payload, FCS value, and trailer Flag Sequence octet via
the Transmit DS3 Framer.
Once the LAPD Transmitter has completed its transmission of the LAPD Message frame, the Framer will gen-
erate an Interrupt to the MIcroprocessor/Microcontroller (if enabled). Afterwards, the LAPD Transmitter will ei-
ther halt its transmission of LAPD Message frames or will proceed to retransmit the LAPD Message frame, re-
peatedly at one-second intervals. In between these transmissions of the LAPD Message frames, the LAPD
Transmitter will be sending a continuous stream of Flag Sequence bytes. The LAPD Transmitter will continue
this behavior until the user has disabled the LAPD Transmitter by writing a “1” into bit 3 (No Data Link) within
the Tx E3 Configuration register.
N
OTE
:
In order to prevent the user’s data (e.g., the PMDL Message within the LAPD Message frame) from mimicking the
Flag Sequence byte or an ABORT Sequence, the LAPD Transmitter will parse through the PMDL Message data and insert
a “0” into this data, immediately following the detection of five (5) consecutive “1’s” (this stuffing occurs while the PMDL
message data is being read in from the Transmit LAPD Message frame. The Remote LAPD Receive (See
Section 5.3.3
will have the responsibility of checking the newly received PMDL messages for a string of five (5) consecutive “1’s” and
removing the subsequent “0” from the payload portion of the incoming LAPD Message.
Figure 106
presents a flow chart diagram.
Figure 106
depicts the procedure (in white boxes) that the user
should use in order to transmit a PMDL message via the LAPD Transmitter, when the LAPD Transmitter is con-
figured to retransmit the LAPD Message frame, repeatedly at One-Second intervals. This figure also indicates
(via the Shaded boxes) what the LAPD Transmitter circuitry will do before and during message transmission.
TXE3 LAPD STATUS AND INTERRUPT REGISTER (ADDRESS = 0X34)
B
IT
7
B
IT
6
B
IT
5
B
IT
4
B
IT
3
B
IT
2
B
IT
1
B
IT
0
Not Used
TxDL Start
TxDL Busy
TxLAPD
Interrupt
Enable
TxLAPD
Interrupt
Status
RO
RO
RO
RO
R/W
RO
R/W
RUR
0
0
0
0
X
X
1
X
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| XRT72L52 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| XRT72L53 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
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| XRT72L56IB | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| XRT72L52IQTR-F | 功能描述:網(wǎng)絡(luò)控制器與處理器 IC RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
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| XRT72L53-75L03PCI | 功能描述:網(wǎng)絡(luò)控制器與處理器 IC with T75L03. RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
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