參數資料
型號： XRT72L58IB
廠商： EXAR CORP
元件分類： 數字傳輸電路
英文描述： Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
中文描述： DATACOM, FRAMER, PBGA388
封裝： 35 X 35 MM, PLASTIC, BGA-388
文件頁數： 68/486頁
文件大?。?/td> 2733K
代理商： XRT72L58IB
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XRT72L58
EIGHT CHANNEL DS3/E3 FRAMER IC WITH HDLC CONTROLLER
á
PRELIMINARY
REV. P1.1.2
49
T
ABLE
2: D
ESCRIPTION
OF
THE
M
ICROPROCESSOR
I
NTERFACE
S
IGNALS
THAT
EXHIBIT
CONSTANT
ROLES
IN
BOTH
THE
I
NTEL
AND
M
OTOROLA
M
ODES
P
IN
N
AME
T
YPE
D
ESCRIPTION
MOTO
I
Selection input for Intel/Motorola μP Interface.
Setting this pin to a logic "High" configures the Microprocessor Interface to operate in the Motorola
mode. Likewise, setting this pin to a logic "Low" configures the Microprocessor Interface to operate
in the Intel Mode.
D[7:0]
I/O
Bi-Directional Data Bus for register read or write operations
A[11:0]
I
Twelve Bit Address Bus input:
This Twelve bit Address Bus is provided to allow the user to select an on-chip register or on-chip
RAM location and Select the desired Framer Channel to address.
CS
I
Chip Select input.
This active-”Low” signal selects the Microprocessor Interface of the UNI device and enables read/
write operations with the on-chip registers/on-chip RAM.
INT
O
Interrupt Request Output:
This open-drain/active-low output signal will inform the local
μP
that the UNI has an interrupt condi-
tion that needs servicing.
T
ABLE
3: P
IN
D
ESCRIPTION
OF
M
ICROPROCESSOR
I
NTERFACE
S
IGNALS
- W
HILE
THE
M
ICROPROCESSOR
I
NTERFACE
IS
O
PERATING
IN
THE
I
NTEL
M
ODE
P
IN
N
AME
E
QUIVALENT
P
IN
IN
I
NTEL
ENVIRONMENT
T
YPE
D
ESCRIPTION
ALE_AS
ALE
I
Address-Latch Enable:
This “active-high” signal is used to latch the contents on
the address bus, A[11:0]. The contents of the Address Bus are latched into the
A[11:0] inputs on the falling edge of ALE_AS. Additionally, this signal can be
used to indicate the start of a burst cycle.
RD_DS
RD*
I
Read Signal:
This “active-low” input functions as the read signal from the local
μP
. When this signal goes "Low", the UNI Microprocessor Interface will place the
contents of the addressed register on the Data Bus pins (D[15:0]). The Data Bus
will be "tri-stated" once this input signal returns "High".
WR_R/W
WR*
I
Write Signal:
This "active-low" input functions as the write signal from the local
μP
. The contents of the Data Bus (D[15:0]) will be written into the addressed reg-
ister (via A[11:0]), on the rising edge of this signal.
RDY_DTCK
READY*
O
Ready Output:
This "active-low" signal is provided by the UNI device, and indi-
cates that the current read or write cycle is to be extended until this signal is
asserted. The local
μP
will typically insert WAIT states until this signal is
asserted. This output will toggle "Low" when the device is ready for the next
Read or Write cycle.
相關PDF資料
PDF描述
XRT72L58 Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
XRT72L71 Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
XRT72L73 Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
XRT72L74 Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
XRT7300IV E3/DS3/STS-1 LINE INTERFACE UNIT
相關代理商/技術參數
參數描述
XRT72L71 制造商:EXAR 制造商全稱:EXAR 功能描述:DS3 ATM UNI/CLEAR CHANNEL FRAMER
XRT72L71ES-00PCI 功能描述:網絡控制器與處理器 IC T73LC00A+T71D00 RoHS:否 制造商:Micrel 產品:Controller Area Network (CAN) 收發(fā)器數量: 數據速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
XRT72L71IQ 功能描述:網絡控制器與處理器 IC RoHS:否 制造商:Micrel 產品:Controller Area Network (CAN) 收發(fā)器數量: 數據速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
XRT72L71IQ-F 功能描述:網絡控制器與處理器 IC Single CH DS3 UNI (3.3V) RoHS:否 制造商:Micrel 產品:Controller Area Network (CAN) 收發(fā)器數量: 數據速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
XRT72L73IB 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Telecommunication IC
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