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參數(shù)資料
| 型號(hào)： | 79RC32V333-150DHI |
| 英文描述： | Microprocessor |
| 中文描述： | 微處理器 |
| 文件頁數(shù)： | 378/654頁 |
| 文件大?。?/td> | 6963K |
| 代理商： | 79RC32V333-150DHI |
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IDT UART Controller
UART Interrupts
79RC32438 User Reference Manual
13 - 4
November 4, 2002
Notes
UART Interrupts
The UART generates six interrupt requests to the interrupt controller:
General
Interrupt 0
. Activated when one of the conditions in the UART0IE register is enabled and
the necessary condition has occurred. This is bit (0) in the UART0II register, inverted, and sent to
the interrupt controller.
TXRDY 0 Interrupt.
Activated depending on the DMA mode set in the FIFO Control Register for
channel 0. An interrupt request is generated under the same conditions that the TXRDY pin for
channel 0 would be asserted. (Refer to industry standard 16550 UART specification.)
1
RXRDY 0 Interrupt
. Activated depending on the DMA mode set in the FIFO Control Register for
channel 0. An interrupt request is generated under the same conditions that the RXRDY pin for
channel 0 would be asserted. (Refer to industry standard 16550 UART specification.)
1
General
Interrupt 1
. Activated when one of the conditions in the UART1IE register is enabled and
the necessary condition has occurred. This is bit (0) in the UART1II register, inverted, and sent to
the interrupt controller.
TXRDY 1 Interrupt.
Activated depending on the DMA mode set in the FIFO Control Register for
channel 1. An interrupt request is generated under the same conditions that the TXRDY pin for
channel 1 would be asserted. (Refer to industry standard 16550 UART specification.)
1
RXRDY 1 Interrupt
. Activated depending on the DMA mode set in the FIFO Control Register for
channel 1. An interrupt request is generated under the same conditions that the RXRDY pin for
channel 1 would be asserted. (Refer to industry standard 16550 UART specification.)
1
UART Channel Reset
The UART provides two independent serial channels. When switching a UART channel between 16550
and 16450 modes, the internal UART FIFOs are not cleared. To support clean switching between modes, a
UART Reset Register (UART[0|1]RR) is added to the standard 16550 UART register definition for each
channel.
The standard 16550 UART registers are described in the Functional Overview section at the beginning
of this chapter.
UART Registers
This section describes the UART registers. For additional information on configuring and operating the
UART, see the 16550 data sheet
2
.
66MHz
9600
430
66MHz
2400
1719
50MHz
9600
326
40MHz
9600
260
33MHz
9600
215
25MHz
9600
163
1.
PC 16550D Dual Universal Asynchronous Receiver/Transmitter with FIFOs
, June 1995, National Semicon-
ductor
.
2.
PC 16550D Dual Universal Asynchronous Receiver/Transmitter with FIFOs
, June 1995, National Semicon-
ductor.
IPBus Clock
Frequency
Baud Rate
Divisor (decimal)
Table 13.3 Divisor Values for Typical Baud Rates and IPBus Clock Frequencies (Part 2 of 2)
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| 79RC32V334-100BB | MICROPROCESSOR|32-BIT|BGA|256PIN|PLASTIC |
| 79RC32V334-100BBI | MICROPROCESSOR|32-BIT|BGA|256PIN|PLASTIC |
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| 79RC32V334-150BB | 8-Pin Flash-Based 8-Bit CMOS Microcontrollers, -40C to +125C, 8-DFN, TUBE |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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| 79RC32V334-100BBGI | 制造商:Integrated Device Technology Inc 功能描述:MPU RC32300 32-Bit 100MHz 3.3V 256-Pin BGA |
| 79RC32V334-100BBI | 制造商:Integrated Device Technology Inc 功能描述:MPU RC32300 32-Bit 100MHz 3.3V 256-Pin BGA |
| 79RC32V334-133BB | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:MICROPROCESSOR|32-BIT|BGA|256PIN|PLASTIC |
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