參數(shù)資料
型號(hào)： 79RC32V333-150DHI
英文描述： Microprocessor
中文描述： 微處理器
文件頁(yè)數(shù)： 455/654頁(yè)
文件大?。?/td> 6963K
代理商： 79RC32V333-150DHI
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IDT Debugging and Performance Monitoring
Event Monitor
79RC32438 User Reference Manual
18 - 19
November 4, 2002
Notes
The event monitor 0 count register has a corresponding compare register. When the value of the
COUNT field in EM0COUNT equals or is greater than the value in the COMPARE field of EM0COMPARE,
then the Triggered (T) bit in the EM0COMPARE register is set. The T bit in the EM0COMPARE register is
presented to the interrupt controller as an interrupt source.
When the EJTAG Debug Interrupt Enable (DIE) bit is set in the EM0COMPARE register, an EJTAG
debug interrupt request is generated to the CPU core whenever the T bit is set in the EM0COMPARE
register. This allows synchronization between the event monitor and an external EJTAG ICE.
Note:
The state of event monitor registers is
not
modified due to a warm reset (i.e., they are not
reset).
Note:
When an event that occurs at the PCLK clock frequency is selected as an event monitor
event source (e.g., CPU instruction executed), the event counter value may be overstated by up
to 12 cycles due to synchronization delays (the counter is updated every 12 CPU cycles).
43
IPBus transaction that transferred between 33 and 48 bytes
44
IPBus transaction that transferred between 49 and 64 bytes
45
IPBus unaligned transfer transaction (i.e., a transaction starting on a
non-word boundary)
46
Number of IPBus transaction merges (each merge is countered within
a transaction)
47
IPBus master index 0 transaction
48
IPBus master index 1 transaction
49
IPBus master index 2 transaction
50
IPBus master index 3 transaction
51
IPBus master index 4 transaction
52
IPBus master index 5 transaction
53
IPBus master index 6 transaction
54
IPBus master index 7 transaction
55
IPBus master index 8 transaction
56
IPBus master index 9 transaction
57
IPBus master index 10 transaction
58
IPBus master index 11 transaction
59
IPBus master index 12 transaction
60
External memory and peripheral bus master granted bus
61
IPBus master index 14 transaction
62
IPBus master index 15 transaction
63
IPBus master index 16 transaction
1.
This field records a maximum count. A shadow counter is maintained that records the actual count, and
this counter is incremented only when a shadow count exceeds the value in an actual counter that selects
this event.
Event Index
Event Description
Table 18.2 Event Monitor Sources (Part 3 of 3)
相關(guān)PDF資料
PDF描述
79RC32V334-100BB MICROPROCESSOR|32-BIT|BGA|256PIN|PLASTIC
79RC32V334-100BBI MICROPROCESSOR|32-BIT|BGA|256PIN|PLASTIC
79RC32V334-133BB MICROPROCESSOR|32-BIT|BGA|256PIN|PLASTIC
79RC32V334-133BBI MICROPROCESSOR|32-BIT|BGA|256PIN|PLASTIC
79RC32V334-150BB 8-Pin Flash-Based 8-Bit CMOS Microcontrollers, -40C to +125C, 8-DFN, TUBE
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
79RC32V334-100BB 制造商:未知廠(chǎng)家 制造商全稱(chēng):未知廠(chǎng)家 功能描述:MICROPROCESSOR|32-BIT|BGA|256PIN|PLASTIC
79RC32V334-100BBG 制造商:Integrated Device Technology Inc 功能描述:MPU RC32300 32-Bit 100MHz 3.3V 256-Pin BGA
79RC32V334-100BBGI 制造商:Integrated Device Technology Inc 功能描述:MPU RC32300 32-Bit 100MHz 3.3V 256-Pin BGA
79RC32V334-100BBI 制造商:Integrated Device Technology Inc 功能描述:MPU RC32300 32-Bit 100MHz 3.3V 256-Pin BGA
79RC32V334-133BB 制造商:未知廠(chǎng)家 制造商全稱(chēng):未知廠(chǎng)家 功能描述:MICROPROCESSOR|32-BIT|BGA|256PIN|PLASTIC
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