參數(shù)資料
型號(hào)： 8051F330
廠商： Electronic Theatre Controls, Inc.
英文描述： Mixed Signal ISP Flash MCU Family
中文描述： 混合信號(hào)ISP的閃存微控制器系列
文件頁(yè)數(shù)： 170/214頁(yè)
文件大?。?/td> 2408K
代理商： 8051F330
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C8051F330/1/2/3/4/5
170
Rev. 1.4
SFR Definition 17.1. SPI0CFG: SPI0 Configuration
Bit 7:
SPIBSY: SPI Busy (read only).
This bit is set to logic 1 when a SPI transfer is in progress (Master or slave Mode).
MSTEN: Master Mode Enable.
0: Disable master mode. Operate in slave mode.
1: Enable master mode. Operate as a master.
CKPHA: SPI0 Clock Phase.
This bit controls the SPI0 clock phase.
0: Data centered on first edge of SCK period.
*
1: Data centered on second edge of SCK period.
*
CKPOL: SPI0 Clock Polarity.
This bit controls the SPI0 clock polarity.
0: SCK line low in idle state.
1: SCK line high in idle state.
SLVSEL: Slave Selected Flag (read only).
This bit is set to logic 1 whenever the NSS pin is low indicating SPI0 is the selected slave. It
is cleared to logic 0 when NSS is high (slave not selected). This bit does not indicate the
instantaneous value at the NSS pin, but rather a de-glitched version of the pin input.
NSSIN: NSS Instantaneous Pin Input (read only).
This bit mimics the instantaneous value that is present on the NSS port pin at the time that
the register is read. This input is not de-glitched.
SRMT: Shift Register Empty (Valid in Slave Mode, read only).
This bit will be set to logic 1 when all data has been transferred in/out of the shift register,
and there is no new information available to read from the transmit buffer or write to the
receive buffer. It returns to logic 0 when a data byte is transferred to the shift register from
the transmit buffer or by a transition on SCK.
NOTE: SRMT = 1 when in Master Mode.
RXBMT: Receive Buffer Empty (Valid in Slave Mode, read only).
This bit will be set to logic 1 when the receive buffer has been read and contains no new
information. If there is new information available in the receive buffer that has not been read,
this bit will return to logic 0.
NOTE: RXBMT = 1 when in Master Mode.
Bit 6:
Bit 5:
Bit 4:
Bit 3:
Bit 2:
Bit 1:
Bit 0:
*Note:
In slave mode, data on MOSI is sampled in the center of each data bit. In master mode, data on MISO is
sampled one SYSCLK before the end of each data bit, to provide maximum settling time for the slave device.
See Table 17.1 for timing parameters.
R
R/W
R/W
R/W
R
R
R
R
Reset Value
00000111
SPIBSY
Bit7
MSTEN
Bit6
CKPHA
Bit5
CKPOL
Bit4
SLVSEL
Bit3
NSSIN
Bit2
SRMT
Bit1
RXBMT
Bit0
SFR Address: 0xA1
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8052 功能描述:連接線 24AWG 1C 404ft 1/2 POUND SPOOL RoHS:否 制造商:Belden Wire & Cable 絞合:19 x 32 電壓額定值:1 kV 長(zhǎng)度:1000 ft 線規(guī) - 美國(guó)線規(guī)（AWG）:20 絕緣材料:Tetraflouroethylene (TFE) 最大溫度:+ 200 C 類型:High Temperature, High Voltage 外殼顏色:Blue (Light) 系列:83027
805200 制造商:BOSTIK 功能描述:EVO-STIK 528 ADHESIVE 500ML
8052-0-0 制造商:Belden Inc 功能描述:SINGLE CONDUCTOR WIRE ROHS COMPLIANT:NO
805-2000 制造商:Xantrex Technology Inc 功能描述:INVERTER/CHARGER, 2KW, 117V; No. of Outputs:1; Input Voltage Max:16VDC; Output Power:2kW; Output Voltage:117VAC; Output Current:17A; Length:145mm; Width:285mm; Height:450mm; Input Voltage:10V DC to 16V DC; Weight:24lb ;RoHS Compliant: NA
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