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參數(shù)資料
| 型號(hào)： | 9S12XDP512DGV2 |
| 英文描述： | Device User Guide for Mask Set L15Y - (Second Silicon - Enhanced Feature Set) |
| 中文描述： | 設(shè)備用戶指南掩模組L15Y - （二硅-增強(qiáng)的功能集） |
| 文件頁(yè)數(shù)： | 73/152頁(yè) |
| 文件大?。?/td> | 1231K |
| 代理商： | 9S12XDP512DGV2 |
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2.3.5 XFC — PLL Loop Filter Pin
Please ask your Motorola representative for the interactive application note to compute PLL loop filter
elements. Any current leakage on this pin must be avoided.
Figure 2-4 PLL Loop Filter Connections
2.3.6 BKGD / MODC — Background Debug and Mode Pin
The BKGD/MODC pin is used as a pseudo-open-drain pin for the background debug communication. It
is used as a MCU operating mode select pin during reset. The state of this pin is latched to the MODC bit
at the rising edge of RESET. The BKGD pin has a pullup device.
2.3.7 PAD[23:08] / AN[15:0] — Port AD Input Pin of ATD1
PAD[23:08] are general purpose input or output pins and analog inputs AN[15:0] of the analog to digital
converter ATD1.
2.3.8 PAD[07:00] / AN[7:0] — Port AD Input Pins of ATD0
PAD[07:00] are general purpose input or output pins and analog inputs AN[7:0] of the analog to digital
converter ATD0.
2.3.9 PA[7:0] / ADDR[15:8] / IVD[15:8] — Port A I/O Pins
PA7-PA0 are general purpose input or output pins. In MCU expanded modes of operation, these pins are
used for the external address bus. In MCU emulation modes of operation, these pins are used for external
address bus and internal visibility read data.
2.3.10 PB[7:1] / ADDR[7:1] / IVD[7:1] — Port B I/O Pins
PB7-PB1 are general purpose input or output pins. In MCU expanded modes of operation, these pins are
used for the external address bus. In MCU emulation modes of operation, these pins are used for external
address bus and internal visibility read data.
MCU
XFC
R
0
C
S
C
P
VDDPLL
VDDPLL
F
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
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