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參數(shù)資料
| 型號(hào)： | A42MX16-3VQ100 |
| 廠商： | Electronic Theatre Controls, Inc. |
| 英文描述： | 40MX and 42MX FPGA Families |
| 中文描述： | 40MX和42MX FPGA系列 |
| 文件頁(yè)數(shù)： | 76/120頁(yè) |
| 文件大?。?/td> | 854K |
| 代理商： | A42MX16-3VQ100 |
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59
4958B–AUTO–11/10
Atmel ATA6285/ATA6286 [Preliminary]
3.12.3
Alternate Port Functions
Most port pins have alternate functions in addition to being general digital I/Os. Figure 3-25
shows how the port pin control signals from the simplified Figure 3-22 on page 55 can be over-
ridden by alternate functions. The overriding signals may not be present in all port pins, but the
figure serves as a generic description applicable to all port pins in the Atmel
AVR microcon-
troller family.
Figure 3-25. Alternate Port Functions
(1)
D
0
1
Q
WRx
RRx
WPx
PTOExn
Pnx
CLR
RESET
Synchronizer
D
ATA
B
U
S
PORTxn
Q
0
1
Q
L
D
Q
D
Q
PINxn
0
1
RESET
RPx
Pxn PULLUP OVERRIDE ENABLE
Pxn PULLUP OVERRIDE VALUE
PUD:
PULL UP DISABLE
PUOExn:
Pxn PORT VALUE OVERRIDE VALUE
PVOVxn:
Pxn PORT VALUE OVERRIDE ENABLE
PVOExn:
Pxn DATA DIRECTION OVERRIDE ENABLE
Pxn PDATA DIRECTION OVERRIDE VALUE
DDOExn:
DDOVxn:
SLEEP CONTROL
SLEEP:
Pxn PORT TOGGLE OVERRIDE ENABLE
PTOExn:
Pxn DIGITAL INPUT ENABLE OVERRIDE VALUE
DIEOVxn:
Pxn DIGITAL INPUT ENABLE OVERRIDE ENABLE
DIEOExn:
I/O CLOCK
RDx:
RPx:
WRITE PORT REGISTER
WRx:
ANALOG INPUT/OUTPUT PINn ON PORTx
DIGITAL INPUT PINn ON PORTx
RRx:
READ PORTx REGISTER
WPx:
WRITE PORTx
AIOxn:
DIxn:
READ PORTx PIN
WDx:
READ DDRx
WRITE DDRx
PUOVxn:
RDx
CLK
I/O
CLK:
I/O
DIEOVxn
DIEOExn
PVOExn
DDOExn
PVOVxn
0
1
PUOExn
PUOVxn
0
1
DDOVxn
SLEEP
PUD
WDx
D
Q
CLR
DDxn
Q
DIxn
AIOxn
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PDF描述 |
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