參數(shù)資料
型號： ADSP-21161NCCAZ100
廠商： Analog Devices Inc
文件頁數(shù)： 13/60頁
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描述： IC DSP CONTROLLER 32BIT 225MBGA
產(chǎn)品培訓(xùn)模塊： SHARC Processor Overview
標(biāo)準(zhǔn)包裝： 1
系列： SHARC®
類型： 浮點(diǎn)
接口： 主機(jī)接口，連接端口，串行端口
時鐘速率： 100MHz
非易失內(nèi)存： 外部
芯片上RAM： 128kB
電壓 - 輸入/輸出： 3.30V
電壓 - 核心： 1.80V
工作溫度： -40°C ~ 105°C
安裝類型： 表面貼裝
封裝/外殼： 225-BGA，CSPBGA
供應(yīng)商設(shè)備封裝： 225-CSPBGA（17x17）
包裝： 托盤
其它名稱： ADSP21161NCCAZ100
Rev. C
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January 2013
POWER DISSIPATION
Total power dissipation has two components: one due to inter-
nal circuitry and one due to the switching of external output
drivers.
Internal power dissipation depends on the instruction execution
sequence and the data operands involved. Using the current
specifications (IDDINPEAK, IDDINHIGH, IDDINLOW, IDDIDLE) from the
Electrical Characteristics on Page 18 and the current-versus-
operation information in Table 8, the programmer can estimate
the ADSP-21161N’s internal power supply (VDDINT) input cur-
rent for a specific application, according to the following
formula:
% Peak I
DD
-INPEAK
% High I
DD
-INHIGH
% Low I
DD
-INLOW
+ % Peak I
DD
-IDLE
= I
DDINT
Figure 8. Core Clock and System Clock Relationship to CLKIN
Table 7. CLKOUT and CCLK Clock Generation Operation
Timing Requirements
Calculation
CLKIN
Input Clock
1/tCK
CLKOUT
External Port System Clock
1/tCKOP
PLLICLK
PLL Input Clock
1/tPLLIN
CCLK
Core Clock
1/tCCLK
tCK
CLKIN Clock Period
1/CLKIN
tCCLK
(Processor) Core Clock Period
1/CCLK
tLCLK
Link Port Clock Period
(tCCLK) LR
tSCLK
Serial Port Clock Period
(tCCLK) SR
tSDK
SDRAM Clock Period
(tCCLK) SDCKR
tSPICLK
SPI Clock Period
(tCCLK) SPIR
1 where:
LR = link port-to-core clock ratio (1, 2, 3, or 1:4, determined by LxCLKD)
SR = serial port-to-core clock ratio (wide range, determined by CLKDIV)
SDCKR = SDRAM-to-Core Clock Ratio (1:1 or 1:2, determined by SDCTL register)
SPIR = SPI-to-Core Clock Ratio (wide range, determined by SPICTL register)
LCLK = Link Port Clock
SCLK = Serial Port Clock
SDK = SDRAM Clock
SPICLK = SPI Clock
CLOCK DOUBLER
x1, x2
RATIOS
x2, x3, x4
PLL
ASYNCHRONOUS EP
HOST
SRAM
SYNCHRONOUS EP
MULTIPROCESSING
SBSRAM
HARDWARE
INTERRUPT
I/O FLAG
TIMER
P
L
IC
L
K
(4
.2
–
5
0
M
H
z
)
CLKDBL
CLKOUT
CLK_CFG1–0
CLKIN
(CRYSTAL OSCILLATOR
4.2–55 MHz)
XTAL
(QUARTZ CRYSTAL
27.5 MHz MAX)
CORE
I/O PROCESSOR
SPI
x1/8 MAX
SERIAL PORTS
x1/2 MAX
SDRAM
x1, x1/2
LINK PORTS
x1, x1/2, x1/3, x1/4
C
L
K
(3
3
.3
–
1
0
M
H
z
)
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PDF描述
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參數(shù)描述
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ADSP-21161NKCA-100Z 制造商:Analog Devices 功能描述:
ADSP-21161NKCAZ100 功能描述:IC DSP CONTROLLER 32BIT 225MBGA RoHS:是 類別:集成電路 (IC) >> 嵌入式 - DSP（數(shù)字式信號處理器） 系列:SHARC® 標(biāo)準(zhǔn)包裝:2 系列:StarCore 類型:SC140 內(nèi)核 接口:DSI，以太網(wǎng)，RS-232 時鐘速率:400MHz 非易失內(nèi)存:外部 芯片上RAM:1.436MB 電壓 - 輸入/輸出:3.30V 電壓 - 核心:1.20V 工作溫度:-40°C ~ 105°C 安裝類型:表面貼裝 封裝/外殼:431-BFBGA，F(xiàn)CBGA 供應(yīng)商設(shè)備封裝:431-FCPBGA（20x20） 包裝:托盤
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ADSP-21261 制造商:AD 制造商全稱:Analog Devices 功能描述:SHARC Embedded Processor
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