參數(shù)資料
型號： AT89LP52-20PU
廠商： Atmel
文件頁數(shù)： 79/117頁
文件大?。?/td> 0K
描述： IC MCU 8051 8K FLASH SPI 40PDIP
標(biāo)準(zhǔn)包裝： 10
系列： 89LP
核心處理器： 8051
芯體尺寸： 8-位
速度： 20MHz
連通性： EBI/EMI，I²C，SPI，UART/USART
外圍設(shè)備： 欠壓檢測/復(fù)位，POR，PWM，WDT
輸入/輸出數(shù)： 36
程序存儲器容量： 8KB（8K x 8）
程序存儲器類型： 閃存
RAM 容量： 256 x 8
電壓 - 電源 (Vcc/Vdd)： 2.4 V ~ 5.5 V
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 40-DIP（0.600"，15.24mm）
包裝： 管件
64
3709D–MICRO–12/11
AT89LP51/52
state of the clock when not currently transmitting/receiving. The SMOD1 bit determines if the
output data is stable for both edges of the clock, or just one.
In Two-Wire configuration Mode 0 may be used as a hardware accelerator for software emula-
tion of serial interfaces such as a half-duplex Serial Peripheral Interface (SPI) master in mode
(0,0) or (1,1) or a Two-Wire Interface (TWI) in master mode. An example of Mode 0 emulating a
TWI master device is shown in Figure 14-2. In this example, the start, stop, and acknowledge
are handled in software while the byte transmission is done in hardware. Falling/rising edges on
TXD are created by setting/clearing SM2. Rising/falling edges on RXD are forced by set-
ting/clearing the P3.0 register bit. SM2 and P3.0 must be 1 while the byte is being transferred.
Figure 14-1. Mode 0 Waveforms (Two-Wire)
Figure 14-2. UART Mode 0 TWI Emulation (SMOD1 = 1)
Table 14-5.
Mode 0 Clock and Data Modes
SM2
SMOD1
Clock Idle
Data Changes
Data Sampled
0
High
While clock is high
Positive edge of clock
0
1
High
Negative edge of clock
Positive edge of clock
1
0
Low
While clock is low
Negative edge of clock
1
Low
Negative edge of clock
Positive edge of clock
7
RXD (TX)
TXD
6
5
4
3
2
1
0
RXD (RX)
01234567
7
RXD (TX)
TXD
6
5
4
3
2
1
0
RXD (RX)
01234567
7
RXD (TX)
TXD
6
5
4
3
2
1
0
RXD (RX)
01234567
7
RXD (TX)
TXD
6
5
4
3
2
1
0
RXD (RX)
01234567
SMOD1 = 0
SM2 = 0
SMOD1 = 1
SM2 = 0
SMOD1 = 0
SM2 = 1
SMOD1 = 1
SM2 = 1
7
(SDA) RXD
(SCL) TXD
6
5
4
3
2
1
0
ACK
SM2
P3.0
Write to SBUF
TI
Sample ACK
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