參數(shù)資料
型號： AT89LP52-20PU
廠商： Atmel
文件頁數(shù)： 91/117頁
文件大小： 0K
描述： IC MCU 8051 8K FLASH SPI 40PDIP
標準包裝： 10
系列： 89LP
核心處理器： 8051
芯體尺寸： 8-位
速度： 20MHz
連通性： EBI/EMI，I²C，SPI，UART/USART
外圍設(shè)備： 欠壓檢測/復(fù)位，POR，PWM，WDT
輸入/輸出數(shù)： 36
程序存儲器容量： 8KB（8K x 8）
程序存儲器類型： 閃存
RAM 容量： 256 x 8
電壓 - 電源 (Vcc/Vdd)： 2.4 V ~ 5.5 V
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 40-DIP（0.600"，15.24mm）
包裝： 管件
75
3709D–MICRO–12/11
AT89LP51/52
16. Instruction Set Summary
The AT89LP51/52 is fully binary compatible with the 8051 instruction set. In Compatibility mode
the AT89LP51/52 has identical execution time with AT89S51/52 and other standard 8051s. The
difference between the AT89LP51/52 in Fast mode and the standard 8051 is the number of
cycles required to execute an instruction. Fast mode instructions may take 1 to 5 clock cycles to
complete. The execution times of most instructions may be computed using Table 16-1. Note
that for the purposes of this table, a clock cycle is one period of the output of the system clock
divider. For Fast mode the divider defaults to 1, so the clock cycle equals the oscillator period.
For Compatibility mode the divider defaults to 2, so the clock cycle is twice the oscillator period,
or conversely the clock count is half the number of oscillator periods.
Table 16-1.
Instruction Execution Times and Exceptions
Generic Instruction Types
Fast Mode Cycle Count Formula
Most arithmetic, logical, bit and transfer instructions
# bytes
Branches and Calls
# bytes + 1
Single Byte Indirect (i.e. ADD A, @Ri, etc.)
2
RET, RETI
4
MOVC
3
MOVX
MUL
2
DIV
4
INC DPTR
2
Arithmetic
Bytes
Clock Cycles
Hex Code
Compatibility
Fast
ADD A, Rn
1
6
1
28-2F
ADD A, direct
2
6
2
25
ADD A, @Ri
1
6
2
26-27
ADD A, #data
26
2
24
ADDC A, Rn
1
6
1
38-3F
ADDC A, direct
2
6
2
35
ADDC A, @Ri
1
6
2
36-37
ADDC A, #data
26
2
34
SUBB A, Rn
1
6
1
98-9F
SUBB A, direct
2
6
2
95
SUBB A, @Ri
1
6
2
96-97
SUBB A, #data
26
2
94
INC Rn
1
6
1
08-0F
INC direct
2
6
2
05
INC @Ri
1
6
2
06-07
INC A
2
6
2
04
DEC Rn
1
6
1
18-1F
DEC direct
2
6
2
15
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