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參數(shù)資料
| 型號： | CP2120-GM |
| 廠商： | Silicon Laboratories Inc |
| 文件頁數(shù)： | 24/24頁 |
| 文件大小： | 0K |
| 描述： | IC I/O EXPANDER I2C/SPI 8B 20QFN |
| 產品培訓模塊： | CP21xx USB Bridge |
| 標準包裝： | 91 |
| 接口： | I²C，SPI |
| 輸入/輸出數(shù)： | 8 |
| 中斷輸出： | 是 |
| 頻率 - 時鐘： | 400kHz |
| 電源電壓： | 3 V ~ 3.6 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 20-VFQFN 裸露焊盤 |
| 供應商設備封裝： | 20-QFN（4x4） |
| 包裝： | 管件 |
| 產品目錄頁面： | 627 (CN2011-ZH PDF) |
| 其它名稱： | 336-1324 |
CP2120
Rev. 0.4
9
5. SPI Slave Bus
The CP2120 provides a four-wire slave SPI interface. The CP2120's SPI Bus activates whenever the SPI Master
pulls the NSS pin low. The master can then clock data into the CP2120 through the Master-Out-Slave-In (MOSI)
pin and receive data from the CP2120 through the Master-In-Slave-Out (MISO) pin. The SPI Master provides the
SPI with a clock source. Figure 2 shows typical connections for an SPI bus.
Figure 2. SPI Bus Typical Connections
SCLK should be held high when idle. Figure 3 shows a CP2120 data transfer on the SPI Bus. If the CP2120 is the
only slave device on the SPI bus, the NSS pin can be tied low.
Figure 3. Slave Mode Data/Clock Timing
MISO
MOSI
SPICLK
CS
SCLK
CS
CP2120
SPI Master
MSB
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
SCK
MOSI
MISO
NSS
相關PDF資料 |
PDF描述 |
|---|---|
| CP2200-GQ | IC ETH CTRLR SNGL-CHIP 48TQFP |
| CP80C86-2Z | IC CPU 16BIT 5V 8MHZ 40-PDIP |
| CP82C50A-5Z | IC ASYNC COMM ELEMENT UART 40DIP |
| CP82C89 | IC ARBITER BUS 5V 8MHZ 20-DIP |
| CPC1465D | IC DC TERMINATION 16-SOIC |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| CP2120-GMR | 功能描述:接口 - 專用 SPI-I2C BRIDGE & GPIO PORT EXPANDER RoHS:否 制造商:Texas Instruments 產品類型:1080p60 Image Sensor Receiver 工作電源電壓:1.8 V 電源電流:89 mA 最大功率耗散: 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:BGA-59 |
| CP2-127-06L | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Analog IC |
| CP2-127-06L-1-RTV-W6 | 制造商:Laird Technologies Inc 功能描述: |
| CP2-127-06LT | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Analog IC |
| CP2-127-06TL | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Analog IC |
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