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參數(shù)資料
| 型號： | CYDD18S72V18-167BGI |
| 廠商： | CYPRESS SEMICONDUCTOR CORP |
| 元件分類： | SRAM |
| 英文描述： | 256K X 72 DUAL-PORT SRAM, 9 ns, PBGA484 |
| 封裝： | 23 X 23 MM, 2.03 MM HEIGHT, 1 MM PITCH, PLASTIC, BGA-484 |
| 文件頁數(shù)： | 24/53頁 |
| 文件大?。?/td> | 2422K |
| 代理商： | CYDD18S72V18-167BGI |
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FullFlex
Document #: 38-06072 Rev. *I
Page 30 of 53
tRSR
Master Reset Recovery Time
5
cycles
tRSF
Master Reset to Outputs Inactive/Hi-Z
12
15
18
ns
tRDY[37]
Master Reset Release to Port Ready
1024
cycles
tCORDY[38]
C Rise to Port Ready
8[34]
9.5[34]
11[34]
ns
Table 19.JTAG Timing
Parameter
Description
–200[27]
–167[27]
–133
Unit
Min.
Max.
Min.
Max.
Min.
Max.
fJTAG
JTAG TAP Controller Frequency
20
MHz
tTCYC
TCK Cycle Time
50
ns
tTH
TCK High Time
20
ns
tTL
TCK Low Time
20
ns
tTMSS
TMS Set-up to TCK Rise
10
ns
tTMSH
TMS Hold to TCK Rise
10
ns
tTDIS
TDI Set-up to TCK Rise
10
ns
tTDIH
TDI Hold to TCK Rise
10
ns
tTDOV
TCK Low to TDO Valid
10
ns
tTDOX
TCK Low to TDO Invalid
0
ns
tJXZ
TCK Low to TDO hi-Z
15
ns
tJZX
TCK Low to TDO Active
15
ns
Notes:
37. READY is a wired OR capable output with a weak pull-down. For a decreased falling delay, connect a 250
resistor to VSS.
38. Add this propagation delay after tRDY for all Master Reset Operations
Table 18.Master Reset Timing
Parameter
Description
–200[27]
–167[27]
–133
Unit
Min.
Max.
Min.
Max.
Min.
Max.
相關PDF資料 |
PDF描述 |
|---|---|
| CYW2330ZITR | PLL FREQUENCY SYNTHESIZER, 2500 MHz, PDSO20 |
| CYW311OXCT | 200 MHz, PROC SPECIFIC CLOCK GENERATOR, PDSO48 |
| CZ23EH-FREQ-OUT23 | VCXO, CLOCK, 1.25 MHz - 65 MHz, CMOS/TTL OUTPUT |
| CZM4-2000 | VCO, 1950 MHz - 2800 MHz |
| CZSH5-40C | 2.5 A, 40 V, SILICON, RECTIFIER DIODE |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| CYDD18S72V18-200BBC | 制造商:Cypress Semiconductor 功能描述:SRAM SYNC DUAL 1.8V 18MBIT 256KX72 0.5NS 484BGA - Bulk |
| CYDD18S72V18-200BBXC | 功能描述:IC SRAM 18MBIT 200MHZ 256LFBGA RoHS:是 類別:集成電路 (IC) >> 存儲器 系列:- 標準包裝:1,000 系列:- 格式 - 存儲器:RAM 存儲器類型:移動 SDRAM 存儲容量:256M（8Mx32） 速度:133MHz 接口:并聯(lián) 電源電壓:1.7 V ~ 1.95 V 工作溫度:-40°C ~ 85°C 封裝/外殼:90-VFBGA 供應商設備封裝:90-VFBGA（8x13） 包裝:帶卷 (TR) 其它名稱:557-1327-2 |
| CYDH2200E | 制造商:Cypress Semiconductor 功能描述:CPLD BOOT EEPROM PROGRAMMING KIT - Bulk |
| CYDIO48 | 制造商:Misc 功能描述: |
| CYDM064A08 | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:1.8V 4K/8K/16K x 16 and 8K/16K x 8 MoBL㈢ Dual-Port Static RAM |
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