Table 02h" />
參數(shù)資料
型號(hào)： DS1865K
廠商： Maxim Integrated Products
文件頁(yè)數(shù)： 55/67頁(yè)
文件大?。?/td> 0K
描述： KIT EVAL FOR DS1865
產(chǎn)品培訓(xùn)模塊： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標(biāo)準(zhǔn)包裝： 1
主要目的： 電信，無(wú)源光學(xué)網(wǎng)絡(luò)（PON）
已用 IC / 零件： DS1865
DS1865
PON Triplexer Control and
Monitoring Circuit
____________________________________________________________________
59
Table 02h, Register BBh: TX-F Enable0 (TX-F EN0)
FACTORY DEFAULT
00h
READ ACCESS
PW2
WRITE ACCESS
PW2
MEMORY TYPE:
Nonvolatile (SEE)
BBh
HTXP EN
LTXP EN
BIAS-HI EN
BIAS MAX EN
RESERVED
FETG EN
bit7
bit0
Configures the maskable interrupt for the Tx-F pin.
bit7
HTXP EN: Enables/disables active interrupts on the TX-F pin due to TXP fast comparisons above
the threshold limit.
0 = Disable (Default).
1 = Enable.
bit6
LTXP EN: Enables/disables active interrupts on the TX-F pin due to TXP fast comparisons below
the threshold limit.
0 = Disable (Default).
1 = Enable.
bit5
BIAS-HI EN: Enables/disables active interrupts on the TX-F pin due to BIAS fast comparisons
above the threshold limit.
0 = Disable (Default).
1 = Enable.
bit4
BIAS MAX EN: Enables/disables active interrupts on the TX-F pin due to BIAS fast comparisons
above the threshold limit.
0 = Disable (Default).
1 = Enable.
bit3:1
RESERVED (Default = 0)
bit0
FETG EN:
0 = Normal FETG operation (Default).
1 = Enables FETG to act as an input to TX-F output.
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