參數(shù)資料
型號(hào)： DS21Q44T+
廠商： Maxim Integrated Products
文件頁數(shù)： 69/105頁
文件大?。?/td> 0K
描述： IC FRAMER ENHANCED E1 4X 128TQFP
標(biāo)準(zhǔn)包裝： 72
控制器類型： E1 調(diào)幀器
接口： 并行/串行
電源電壓： 2.97 V ~ 3.63 V
電流 - 電源： 75mA
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 128-LQFP
供應(yīng)商設(shè)備封裝： 128-LQFP（14x20）
包裝： 管件
DS21Q44
66 of 105
RHIR: RECEIVE HDLC INFORMATION REGISTER (Address=B3 Hex)
(MSB)
(LSB)
RABT
RCRCE
ROVR
RVM
REMPTY
POK
CBYTE
OBYTE
SYMBOL
POSITION
NAME AND DESCRIPTION
RABT
RHIR.7
Abort Sequence Detected. Set whenever the HDLC controller
sees 7 or more ones in a row.
RCRCE
RHIR.6
CRC Error. Set when the CRC checksum is in error.
ROVR
RHIR.5
Overrun. Set when the HDLC controller has attempted to write
a byte into an already full receive FIFO.
RVM
RHIR.4
Valid Message. Set when the HDLC controller has detected and
checked a complete HDLC packet.
REMPTY
RHIR.3
Empty. A real–time bit that is set high when the receive FIFO
is empty.
POK
RHIR.2
Packet OK. Set when the byte available for reading in the
receive FIFO at RHFR is the last byte of a valid message (and
hence no abort was seen, no overrun occurred, and the CRC was
correct).
CBYTE
RHIR.1
Closing Byte. Set when the byte available for reading in the
receive FIFO at RFDL is the last byte of a message (whether the
message was valid or not).
OBYTE
RHIR.0
Opening Byte. Set when the byte available for reading in the
receive FIFO at RHFR is the first byte of a message.
Note: The RABT, RCRCE, ROVR, and RVM bits are latched and are cleared when read.
RHFR: RECEIVE HDLC FIFO REGISTER (Address=B4 Hex)
(MSB)
(LSB)
HDLC7
HDLC6
HDLC5
HDLC4
HDLC3
HDLC2
HDLC1
HDLC0
SYMBOL
POSITION
NAME AND DESCRIPTION
HDLC7
RHFR.7
HDLC Data Bit 7. MSB of a HDLC packet data byte.
HDLC6
RHFR.6
HDLC Data Bit 6.
HDLC5
RHFR.5
HDLC Data Bit 5.
HDLC4
RHFR.4
HDLC Data Bit 4.
HDLC3
RHFR.3
HDLC Data Bit 3.
HDLC2
RHFR.2
HDLC Data Bit 2.
HDLC1
RHFR.1
HDLC Data Bit 1.
HDLC0
RHFR.0
HDLC Data Bit 0. LSB of a HDLC packet data byte.
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PDF描述
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