參數(shù)資料
型號(hào)： DS31412N
廠商： Maxim Integrated Products
文件頁(yè)數(shù)： 20/89頁(yè)
文件大?。?/td> 0K
描述： IC 12CH DS3/3 FRAMER 349-BGA
標(biāo)準(zhǔn)包裝： 1
控制器類(lèi)型： DS3/E3 調(diào)幀器
接口： LIU
電源電壓： 3.135 V ~ 3.465 V
電流 - 電源： 960mA
工作溫度： -40°C ~ 85°C
安裝類(lèi)型： 表面貼裝
封裝/外殼： 349-BGA 裸露焊盤(pán)
供應(yīng)商設(shè)備封裝： 349-HCBGA（27x27）
包裝： 托盤(pán)
DS3146/DS3146/DS31412 6-/8-/12-Channel DS3/E3 Framers
27 of 89
Register Name:
MC5
Register Description:
Master Configuration Register 5
Register Address:
05h
Bit #
7
6
5
4
3
2
1
0
Name
RNEGI
RPOSI
RCLKI
TNEGH
TPOSH
TNEGI
TPOSI
TCLKI
Default
0
Bit 0: TCLK Invert Enable (TCLKI)
0 = do not invert the TCLK signal (normal mode)
1 = invert the TCLK signal (inverted mode)
Bit 1: TPOS/TNRZ Invert Enable (TPOSI)
0 = do not invert the TPOS/TNRZ signal (normal mode)
1 = invert the TPOS/TNRZ signal (inverted mode)
Bit 2: TNEG Invert Enable (TNEGI)
0 = do not invert the TNEG signal (normal mode)
1 = invert the TNEG signal (inverted mode)
Bit 3: TPOS/TNRZ Force-High Enable (TPOSH). The TPOS/TNRZ pin can be forced low by setting both the
TPOSH and TPOSI control bits.
0 = allow normal transmit data to appear at the TPOS/TNRZ pin (normal mode)
1 = force the TPOS/TNRZ signal high (force high mode, can be inverted)
Bit 4: TNEG Force-High Enable (TNEGH). The TNEG pin can be forced low by setting both the TNEGH and
TNEGI control bits.
0 = allow normal transmit data to appear at the TNEG pin (normal mode)
1 = force the TNEG signal high (force high mode, can be inverted)
Bit 5: RCLK Invert Enable (RCLKI)
0 = do not invert the RCLK signal (normal mode)
1 = invert the RCLK signal (inverted mode)
Bit 6: RPOS/RNRZ Invert Enable (RPOSI)
0 = do not invert the RPOS/RNRZ signal (normal mode)
1 = invert the RPOS/RNRZ signal (inverted mode)
Bit 7: RNEG/RLCV Invert Enable (RNEGI)
0 = do not invert the RNEG/RLCV signal (normal mode)
1 = invert the RNEG/RLCV signal (inverted mode)
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PDF描述
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