參數(shù)資料
型號： DSP56303VF100B1
廠商： Freescale Semiconductor
文件頁數(shù)： 35/108頁
文件大小： 0K
描述： IC DSP 24BIT 100MHZ 196-BGA
標(biāo)準(zhǔn)包裝： 630
系列： DSP563xx
類型： 定點(diǎn)
接口： 主機(jī)接口，SSI，SCI
時鐘速率： 100MHz
非易失內(nèi)存： ROM（576 B）
芯片上RAM： 24kB
電壓 - 輸入/輸出： 3.30V
電壓 - 核心： 3.30V
工作溫度： -40°C ~ 100°C
安裝類型： 表面貼裝
封裝/外殼： 196-LBGA
供應(yīng)商設(shè)備封裝： 196-MAPBGA（15x15）
包裝： 托盤
DSP56303 Technical Data, Rev. 11
2-12
Freescale Semiconductor
Specifications
2.5.5
External Memory Expansion Port (Port A)
2.5.5.1 SRAM Timing
Table 2-8.
SRAM Read and Write Accesses
No.
Characteristics
Symbol
Expression1
100 MHz
Unit
Min
Max
100
Address valid and AA assertion pulse width2
tRC, tWC
(WS + 1)
× T
C 4.0
[1
≤WS ≤3]
(WS + 2)
× TC 4.0
[4
≤WS ≤7]
(WS + 3)
× TC 4.0
[WS
≥ 8]
16.0
56.0
106.0
—
ns
101
Address and AA valid to WR assertion
tAS
0.25
× TC 2.0
[WS = 1]
0.75
× T
C 2.0
[2
≤WS ≤3]
1.25
× TC 2.0
[WS
≥ 4]
0.5
5.5
10.5
—
ns
102
WR assertion pulse width
tWP
1.5
× TC 4.0
[WS = 1]
WS
× TC 4.0
[2
≤WS ≤3]
(WS
0.5) × T
C 4.0
[WS
≥ 4]
11.0
16.0
31.0
—
ns
103
WR deassertion to address not valid
tWR
0.25
× T
C 2.0
[1
≤WS ≤3]
1.25
× TC 4.0
[4
≤WS ≤7]
2.25
× TC 4.0
[WS
≥ 8]
0.5
8.5
18.5
—
ns
104
Address and AA valid to input data valid
tAA, tAC
(WS + 0.75)
× TC 5.0
[WS
≥ 1]
—12.5
ns
105
RD assertion to input data valid
tOE
(WS + 0.25)
× TC – 5.0
[WS
≥ 1]
—7.5
ns
106
RD deassertion to data not valid (data hold time)
tOHZ
0.0
—
ns
107
Address valid to WR deassertion2
tAW
(WS + 0.75)
× T
C 4.0
[WS
≥ 1]
13.5
—
ns
108
Data valid to WR deassertion (data setup time)
tDS (tDW)(WS 0.25) × TC 3.0
[WS
≥ 1]
4.5
—
ns
109
Data hold time from WR deassertion
tDH
0.25
× T
C 2.0
[1
≤WS ≤3]
1.25
× TC 2.0
[4
≤WS ≤7]
2.25
× TC 2.0
[WS
≥ 8]
0.5
10.5
20.5
—
ns
110
WR assertion to data active
—
0.75
× TC 3.7
[WS = 1]
0.25
× T
C – 3.7
[2
≤WS ≤3]
–0.25
× TC 3.7
[WS
≥ 4]
3.8
–1.2
–6.2
—
ns
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PDF描述
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