參數(shù)資料
型號： DSP56855BUE
廠商： Freescale Semiconductor
文件頁數(shù)： 20/52頁
文件大?。?/td> 0K
描述： IC DSP 16BIT 120MHZ 100-LQFP
標(biāo)準包裝： 90
系列： 568xx
核心處理器： 56800E
芯體尺寸： 16-位
速度： 120MHz
連通性： EBI/EMI，SCI，SSI
外圍設(shè)備： DMA，POR，WDT
輸入/輸出數(shù)： 18
程序存儲器容量： 48KB（24K x 16）
程序存儲器類型： SRAM
RAM 容量： 24K x 16
電壓 - 電源 (Vcc/Vdd)： 1.62 V ~ 1.98 V
振蕩器型： 外部
工作溫度： -40°C ~ 85°C
封裝/外殼： 100-LQFP
包裝： 托盤
External Memory Interface Timing
56855 Technical Data, Rev. 6
Freescale Semiconductor
27
Figure 4-10 External Memory Interface Timing
Table 4-7 External Memory Interface Timing
Operating Conditions: VSS = VSSIO = VSSA = 0 V, VDD = 1.62-1.98 V, VDDIO = VDDA = 3.0–3.6V, TA = –40× to +120×C, CL 50pF, P = 8.333ns
Characteristic
Symbol
Wait States
Configuration
DM
Wait States
Controls
Unit
Address Valid to WR Asserted
tAWR
WWS=0
-0.79
0.50
WWSS
ns
WWS>0
-1.98
0.69
WR Width Asserted to WR
Deasserted
tWR
WWS=0
-0.86
0.19
WWS
ns
WWS>0
-0.01
0.00
Data Out Valid to WR Asserted
tDWR
WWS=0
-1.52
0.00
WWSS
ns
WWS=0
- 5.69
0.25
WWS>0
-2.10
0.19
WWS>0
-4.66
0.50
Valid Data Out Hold Time after WR
Deasserted
tDOH
-1.47
0.25
WWSH
ns
Valid Data Out Set Up Time to WR
Deasserted
tDOS
-2.36
0.19
WWS,WWSS
ns
-4.67
0.50
Valid Address after WR
Deasserted
tWAC
-1.60
0.25
WWSH
RD Deasserted to Address Invalid
tRDA
- 0.44
0.00
RWSH
ns
tDRD
tRDD
tAD
tDOH
tDOS
tDWR
tRDWR
tWAC
tWRRD
tWR
tAWR
tWRWR
tARDD
tRDA
tRDRD
tRD
tARDA
Data Out
Data In
A0-Axx,CS
RD
WR
D0-D15
Note: During read-modify-write instructions and internal instructions, the address lines do not change state.
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PDF描述
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