參數(shù)資料
型號(hào)： DSP56855BUE
廠商： Freescale Semiconductor
文件頁(yè)數(shù)： 31/52頁(yè)
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描述： IC DSP 16BIT 120MHZ 100-LQFP
標(biāo)準(zhǔn)包裝： 90
系列： 568xx
核心處理器： 56800E
芯體尺寸： 16-位
速度： 120MHz
連通性： EBI/EMI，SCI，SSI
外圍設(shè)備： DMA，POR，WDT
輸入/輸出數(shù)： 18
程序存儲(chǔ)器容量： 48KB（24K x 16）
程序存儲(chǔ)器類(lèi)型： SRAM
RAM 容量： 24K x 16
電壓 - 電源 (Vcc/Vdd)： 1.62 V ~ 1.98 V
振蕩器型： 外部
工作溫度： -40°C ~ 85°C
封裝/外殼： 100-LQFP
包裝： 托盤(pán)
Enhanced Synchronous Serial Interface (ESSI) Timing
56855 Technical Data, Rev. 6
Freescale Semiconductor
37
Figure 4-24 Master Mode Timing Diagram
3. All the timings for the ESSI are given for a non-inverted serial clock polarity (TSCKP=0 in SCR2 and RSCKP=0 in SCSR)
and a non-inverted frame sync (TFSI=0 in SCR2 and RFSI=0 in SCSR). If the polarity of the clock and/or the frame sync have
been inverted, all the timings remain valid by inverting the clock signal SCK/SC0 and/or the frame sync SC2/SC1 in the tables
and in the figures.
4. 50 percent duty cycle
5. bl = bit length; wl = word length
tTHM
tTSM
tHM
tSM
tRFSWLM
tRFSWHM
tRFBLM
tRFSBHM
tTXHIM
tTXNVM
tTXVM
tTXEM
tTFSWLM
tTFSWHM
tTFSBLM
tTFSBHM
tSCKL
tSCKW
tSCKH
First Bit
Last Bit
SCK output
SC2 (bl) output
SC2 (wl) output
STD
SC0 output
SC1 (bl) output
SC1 (wl) output
SRD
相關(guān)PDF資料
PDF描述
DSP56857BUE IC DSP 16BIT 120MHZ 100-LQFP
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DSP56F802TA80E IC DSP 60MHZ 16KB FLASH 32-LQFP
DSP56F803BU80E IC DSP 80MHZ 64KB FLASH 100LQFP
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