參數(shù)資料
型號： EF4442CMG/B(Z63)
廠商： ATMEL CORP
元件分類： 通信及網(wǎng)絡(luò)
英文描述： SPECIALTY TELECOM CIRCUIT, CDIP28
封裝： SIDE BRAZED, CERAMIC, DIP-28
文件頁數(shù)： 719/1069頁
文件大?。?/td> 14303K
代理商： EF4442CMG/B(Z63)
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719
SAM4CP [DATASHEET]
43051E–ATPL–08/14
35.4
Product Dependencies
35.4.1 I/O Lines
The UART pins are multiplexed with PIO lines. The user must first configure the corresponding PIO Controller to enable
I/O line operations of the UART.
35.4.2 Power Management
The UART clock can be controlled through the Power Management Controller (PMC). In this case, the user must first
configure the PMC to enable the UART clock. Usually, the peripheral identifier used for this purpose is 1.
35.4.3 Interrupt Source
The UART interrupt line is connected to one of the interrupt sources of the Interrupt Controller. Interrupt handling requires
programming of the Interrupt Controller before configuring the UART.
35.4.4 Optical Interface
The UART optical interface requires configuration of the PMC to generate 4096 kHz or 8192 kHz on the PLLA prior to
any transfer.
35.5
Functional Description
The UART operates in asynchronous mode only and supports only 8-bit character handling (with parity). It has no clock
pin.
The UART is made up of a receiver and a transmitter that operate independently, and a common baud rate generator.
Receiver timeout and transmitter time guard are not implemented. However, all the implemented features are compatible
with those of a standard USART.
35.5.1 Baud Rate Generator
The baud rate generator provides the bit period clock named baud rate clock to both the receiver and the transmitter.
The baud rate clock is the peripheral clock divided by 16 times the clock divisor (CD) value written in the Baud Rate
Generator Register (UART_BRGR). If UART_BRGR is set to 0, the baud rate clock is disabled and the UART remains
inactive. The maximum allowable baud rate is peripheral clock divided by 16. The minimum allowable baud rate is
peripheral clock divided by (16 x 65536).
Table 35-2.
I/O Lines
Instance
Signal
I/O Line
Peripheral
UART0
URXD0
PB4
A
UART0
UTXD0
PB5
A
UART1
URXD1
PC1
A
UART1
UTXD1
PC0
A
Baud Rate
16
CD
-------------------------------------------
=
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PDF描述
EF4442CMB/T(Z63) SPECIALTY TELECOM CIRCUIT, CDIP28
E5550F-DOW SPECIALTY TELECOM CIRCUIT, UUC7
E5530H-230-S8 SPECIALTY TELECOM CIRCUIT, PDSO8
E5530H-230-DOW SPECIALTY TELECOM CIRCUIT, UUC
ECM2A5C3A12-29.939MTR QUARTZ CRYSTAL RESONATOR, 29.939 MHz
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參數(shù)描述
EF4442CVZ63 制造商:e2v technologies 功能描述:EF4442CVZ63 - Trays
EF4442E1MB/TZ63 制造商:e2v technologies 功能描述:BUFFER RECEIVER - Trays
EF4442PVZ63 制造商:e2v technologies 功能描述:MULTI CH RCVR 28PDIP - Trays
EF45-30 制造商:ABB Control 功能描述:RELAYOVERLOAD9-30A 制造商:ABB Control 功能描述:RELAY,OVERLOAD,9-30A
EF45-45 制造商:ABB Control 功能描述:RELAYOVERLOAD15-45A
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