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參數(shù)資料
| 型號(hào)： | HM5425161BTT-10 |
| 廠商： | ELPIDA MEMORY INC |
| 元件分類： | DRAM |
| 英文描述： | 256M SSTL_2 interface DDR SDRAM 143 MHz/133 MHz/125 MHz/100 MHz 4-Mword 】 16-bit 】 4-bank/8-Mword 】 8-bit 】 4-bank/ 16-Mword 】 4-bit 】 4-bank |
| 中文描述： | 16M X 16 DDR DRAM, 0.8 ns, PDSO66 |
| 封裝： | 0.400 INCH, PLASTIC, TSOP2-66 |
| 文件頁(yè)數(shù)： | 9/65頁(yè) |
| 文件大?。?/td> | 489K |
| 代理商： | HM5425161BTT-10 |
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HM5425161B, HM5425801B, HM5425401B Series
Data Sheet E0086H20
9
Block Diagram
Column address
counter
Column address
buffer
Row address
buffer
Bank
select
Refresh
counter
Address register
Address (A12, BA0, BA1)
AY0 to AY11
AX0 to AX12
BA0, BA1
A0 to A12,
BA0, BA1
DQ*
2
Input
buffer
Output
buffer
DQS
buffer
Row
decoder
S
C
Bank 0
*
1
*
1
*
1
*
1
Notes: 1. 8192 row
×
512 column
×
16 bit: HM5425161B
8192 row
×
1024 column
×
8 bit: HM5425801B
8192 row
×
2048 column
×
4 bit: HM5425401B
2. DQ0 to DQ15: HM5425161B
DQ0 to DQ7: HM5425801B
DQ0 to DQ3: HM5425401B
Row
decoder
S
C
Bank 1
Row
decoder
S
C
Bank 2
Row
decoder
CLK
CKE
DM,
DMU/DML
DLL
DQS,
DQSU/DQSL
CLK
RAS
CAS
WE
CS
S
C
Bank 3
C
Mode register
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| HM5425801BTT-10 | 256M SSTL_2 interface DDR SDRAM 143 MHz/133 MHz/125 MHz/100 MHz 4-Mword 】 16-bit 】 4-bank/8-Mword 】 8-bit 】 4-bank/ 16-Mword 】 4-bit 】 4-bank |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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