參數(shù)資料
型號: IDT82V3280EQG
廠商: IDT, Integrated Device Technology Inc
文件頁數(shù): 134/171頁
文件大小: 0K
描述: IC PLL WAN SE STRATUM 2 100TQFP
標準包裝: 90
類型: 時鐘/頻率發(fā)生器,多路復用器
PLL:
主要目的: 以太網(wǎng),SONET/SDH,Stratum
輸入: CMOS,LVDS,PECL
輸出: CMOS,LVDS,PECL
電路數(shù): 1
比率 - 輸入:輸出: 14:9
差分 - 輸入:輸出: 是/是
頻率 - 最大: 622.08MHz
電源電壓: 3 V ~ 3.6 V
工作溫度: -40°C ~ 85°C
安裝類型: 表面貼裝
封裝/外殼: 100-LQFP 裸露焊盤
供應商設備封裝: 100-TQFP-EP(14x14)
包裝: 托盤
IDT82V3280
WAN PLL
Programming Information
65
December 9, 2008
7.2
REGISTER DESCRIPTION
7.2.1
GLOBAL CONTROL REGISTERS
ID[7:0] - Device ID 1
71
OUT7_PATH_SEL[3:0]
OUT7_DIVIDER[3:0]
72
OUT8_PAT
H_SEL
OUT8_EN
T4_INPUT
_FAIL
AMI_OUT_
DUTY
400HZ_SE
L
OUT9_INV OUT7_INV OUT6_INV
73
OUT9_PAT
H_SEL
OUT9_EN
T4_INPUT
_FAIL
OUT5_INV OUT4_INV OUT3_INV OUT2_INV OUT1_INV
74
IN_2K_4K_
8K_INV
8K_EN
2K_EN
2K_8K_PU
L_POSITI
ON
8K_INV
8K_PUL
2K_INV
2K_PUL
PBO & Phase Offset Control Registers
78
IN_NOISE
_WINDOW
-
PH_MON_
EN
PH_MON_
PBO_EN
PH_TR_MON_LIMT[3:0]
7A
PH_OFFSET[7:0]
7B
PH_OFFS
ET_EN
--
---
PH_OFFSET[9:8]
Synchronization Configuration Registers
7C
-
SYNC_MON_LIMT[2:0]
-
7D
---
SYNC_PH1[1:0]
Table 42: Register List and Map (Continued)
Address
(Hex)
Register Name
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
Reference
Page
Address: 00H
Type: Read
Default Value: 10001000
Bit
Name
Description
7 - 0
ID[7:0]
Refer to the description of the ID[15:8] bits (b7~0, 01H).
765
432
1
0
ID7
ID6
ID5
ID4
ID3
ID2
ID1
ID0
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PDF描述
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VI-JWN-MW-B1 CONVERTER MOD DC/DC 18.5V 100W
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IDT82V3280PFG IC PLL WAN SE STRATUM 2 100-TQFP
MS27467E25B19SC CONN PLUG 19POS STRAIGHT W/SCKT
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參數(shù)描述
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