參數(shù)資料
型號: IDT82V3355TFG
廠商: IDT, Integrated Device Technology Inc
文件頁數(shù): 68/135頁
文件大小: 0K
描述: IC PLL WAN SYNC ETH 64-TQFP
標(biāo)準(zhǔn)包裝: 1
類型: 時(shí)鐘/頻率發(fā)生器,多路復(fù)用器
PLL:
主要目的: 以太網(wǎng),SONET/SDH,Stratum
輸入: CMOS,LVDS,PECL
輸出: CMOS,LVDS,PECL
電路數(shù): 1
比率 - 輸入:輸出: 3:2
差分 - 輸入:輸出: 是/是
頻率 - 最大: 622.08MHz
電源電壓: 3 V ~ 3.6 V
工作溫度: -40°C ~ 85°C
安裝類型: 表面貼裝
封裝/外殼: 64-LQFP
供應(yīng)商設(shè)備封裝: 64-TQFP(10x10)
包裝: 托盤
其它名稱: 82V3355TFG
IDT82V3355
SYNCHRONOUS ETHERNET WAN PLL
Functional Description
38
May 19, 2009
Table 27: Outputs on OUT1 & OUT2 if Derived from T4 APLL
OUTn_DIVIDER[3
:0] (Output
Divider) 1
outputs on
OUT1 & OUT2 if derived from T4 APLL output 2
77.76 MHz X 4 12E1 X 4 16E1 X 4 24T1 X 4 16T1 X 4
E3
T3
GSM
(26 MHz X 2)
ETH
OBSAI
(30.72 MHz X 10)
GPS
(40 MHz)
0000
Output is disabled (output low).
0001
622.08 MHz 3
0010
311.04 MHz 3
48E1
64E1
96T1
64T1
E3
T3
52 MHz
312.5 MHz
0011
155.52 MHz
24E1
32E1
48T1
32T1
26 MHz
156.25 MHz
153.6 MHz
20 MHz
0100
77.76 MHz
12E1
16E1
24T1
16T1
13 MHz
76.8 MHz
10 MHz
0101
51.84 MHz
8E1
16T1
0110
38.88 MHz
6E1
8E1
12T1
8T1
38.4 MHz
5 MHz
0111
25.92 MHz
4E1
8T1
1000
19.44 MHz
3E1
4E1
6T1
4T1
125 MHz
1001
2E1
4T1
25 MHz
1010
2E1
3T1
2T1
5 MHz
1011
6.48 MHz
E1
2T1
1100
E1
T1
62.5 MHz
1101
T1
1110
1111
Output is disabled (output high).
Note:
1. n = 1 or 2. Each output is assigned a frequency divider.
2. In the APLL, the selected T0/T4 DPLL output may be multiplied. E1 = 2.048 MHz, T1 = 1.544 MHz, E3 = 34.368 MHz, T3 = 44.736 MHz. The blank cell means the configuration is
reserved.
3. The 622.08 MHz and 311.04 MHz differential signals are only output on OUT1.
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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