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參數(shù)資料
| 型號(hào)： | LC5256MC-5F256C |
| 廠商： | LATTICE SEMICONDUCTOR CORP |
| 元件分類： | PLD |
| 英文描述： | 3.3V, 2.5V and 1.8V In-System Programmable eXpanded Programmable Logic Device XPLD⑩ Family |
| 中文描述： | EE PLD, 6 ns, PBGA256 |
| 封裝： | FPBGA-256 |
| 文件頁數(shù)： | 55/92頁 |
| 文件大小： | 378K |
| 代理商： | LC5256MC-5F256C |
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Lattice Semiconductor
ispXPLD 5000MX Family Data Sheet
55
Global Clock LVDS pair options: GCLK0 and GCLK1, as well as GCLK2 and GCLK3, can be paired together to
receive differential clocks; where GCLK0 and GCLK3 are the positive LVDS inputs
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GND
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G10
G8
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G4
G2
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VCCO0
GND (Bank 0)
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G30
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G28
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G26
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H29
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H25
H24
H3
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NC
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GND (Bank 0)
E6
A6
A5
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A3
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C5
C6
D5
D6
VCCO0
GND (Bank 0)
ispXPLD 5256MX Logic Signal Connections (Continued)
sysIO Bank
LVDS Pair
Primary Macrocell/
Function
Alternate Outputs
Macrocell 1
Alternate Input
256 fpBGA
Ball Number
Macrocell 2
相關(guān)PDF資料 |
PDF描述 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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