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參數(shù)資料
| 型號(hào)： | LC5256MC-5F256C |
| 廠商： | LATTICE SEMICONDUCTOR CORP |
| 元件分類： | PLD |
| 英文描述： | 3.3V, 2.5V and 1.8V In-System Programmable eXpanded Programmable Logic Device XPLD⑩ Family |
| 中文描述： | EE PLD, 6 ns, PBGA256 |
| 封裝： | FPBGA-256 |
| 文件頁(yè)數(shù)： | 63/92頁(yè) |
| 文件大小： | 378K |
| 代理商： | LC5256MC-5F256C |
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Lattice Semiconductor
ispXPLD 5000MX Family Data Sheet
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B5
A3
B4
B3
C5
C6
D5
A10
A9
C9
D9
F9
E9
A8
V
CCO0
D6
B8
GND (Bank 0)
N30
N28
N26
N24
N22
N21
N20
N18
N16
N14
N12
V
CCO0
N10
GND (Bank 0)
N8
N6
N5
N4
N2
N0
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V
CCO0
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GND (Bank 0) GND (Bank 0)
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A2
B2
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A7
B7
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B5
B6
C7
E8
E7
E6
D6
D8
F8
F7
D7
C6
C5
C4
D5
1. Not available for differential pair.
Global Clock LVDS pair options: GCLK0 and GCLK1, as well as GCLK2 and GCLK3, can be paired together to
receive differential clocks; where GCLK0 and GCLK3 are the positive LVDS inputs.
ispXPLD 5512MX Logic Signal Connections (Continued)
sysIO
Bank
LVDS
Pair
Primary Macrocell/
Function
Alternate Outputs
Macrocell 1 Macrocell 2
Alternate
Input
208 PQFP
Pin Number
256 fpBGA
Ball Number
484 fpBGA
Ball Number
相關(guān)PDF資料 |
PDF描述 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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