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參數(shù)資料
| 型號： | LC5256MC-5F256C |
| 廠商： | LATTICE SEMICONDUCTOR CORP |
| 元件分類： | PLD |
| 英文描述： | 3.3V, 2.5V and 1.8V In-System Programmable eXpanded Programmable Logic Device XPLD⑩ Family |
| 中文描述： | EE PLD, 6 ns, PBGA256 |
| 封裝： | FPBGA-256 |
| 文件頁數(shù)： | 87/92頁 |
| 文件大?。?/td> | 378K |
| 代理商： | LC5256MC-5F256C |
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Lattice Semiconductor
ispXPLD 5000MX Family Data Sheet
87
Global Clock LVDS pair options: GCLK0 and GCLK1, as well as GCLK2 and GCLK3, can be paired together to receive differen-
tial clocks; where GCLK0 and GCLK3 are the positive LVDS inputs.
相關PDF資料 |
PDF描述 |
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參數(shù)描述 |
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