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參數(shù)資料
| 型號： | MC68302FC20 |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | Integrated Multiprotocol Processor User’s Manual |
| 中文描述： | RISC PROCESSOR, PQFP132 |
| 封裝： | PLASTIC, QFP-132 |
| 文件頁數(shù)： | 393/480頁 |
| 文件大?。?/td> | 1815K |
| 代理商： | MC68302FC20 |
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MC68302 Applications
MOTOROLA
MC68302 USER’S MANUAL
D-43
for a given protocol. For HDLC and transparent, this is every 16 bits; whereas, in the other
protocols, it is every 8 bits on receive and every 16 bits on transmit.
This application does not address the issue of choosing whether a master-slave arrange-
ment is the best approach for your application, but rather looks at the design issues that
need to be addressed once the approach seems reasonable. (Most applications usually find
the master-slave approach shown in Figure D-19 quite acceptable for data rates up to 64
kbps on each of the nine SCCs. Any comments on rates beyond this value tend to be less
general and more application dependent.)
D.7.1 Synchronous vs. Asynchronous Accesses
When a device is in slave mode, there are two different ways it can be accessed: synchro-
nously and asynchronously.
When the MC68302 enters slave mode, it is initialized with asynchronous accesses. The
term “asynchronous” refers to the fact that the master does not need to supply signals to the
slave on particular system clock edges, as required in synchronous. However, asynchro-
nous accesses are always and only three waits states for both reads and writes. In general,
this is the suggested method of accessing the MC68302 in slave mode. These accesses are
much simpler than in synchronous timing. Any performance loss is minimal since, once the
MC68302 is initialized, accesses to it are rare. The SDMA channels, which are unaffected
by this choice, can still operate with zero wait states and comprise most of the slave
MC68302 activity.
If the SAM bit in the SCR is set, the following accesses to the slave MC68302 will be syn-
chronous. Writes will be zero wait states, and reads can be either zero or one wait state,
based on the EMWS bit in the SCR. The EMWS bit is almost always required to meet syn-
chronous setup times. Synchronous accesses should be used when one master MC68302
is accessing another slave MC68302 without any intervening glue (like buffers). In this case,
the synchronous timings can be met with proper clocking.
D.7.2 Clocking
The master clock out (CLKO) line should be connected to the EXTAL input of the slaves,
allowing the master MC68302 to perform zero wait state writes and one wait state reads
from the slave MC68302 at full 16.67-MHz operation in synchronous mode. The guaranteed
propagation delay between EXTAL and CLKO is 2-11 ns at 16.67-MHz operation. The typ-
ical delay is about 5 ns.
If a single external clock is required to drive the inputs to all the MC68302 EXTAL pins, the
skew between EXTAL and CLKO must be watched by the designer. In the case of synchro-
nous accesses, this will certainly slow the overall frequency that can be designed.
D.7.3 Programming the Base Address Registers (BARs)
The next issue is how to program the three BARs on each of the MC68302s considering they
have the same address ($0F2). Figure D-19 shows an easy method of programming the
BAR. The master MC68302 first programs its BAR at $0000F2. For each slave, it writes the
slave's parallel l/O line with a zero and writes to $8000F2 to program the slave's BAR. This
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| MC68302FC25 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:Integrated Multiprotocol Processor User’s Manual |
| MC68302FC25C | 功能描述:IC MPU MULTI-PROTOCOL 132-PQFP RoHS:否 類別:集成電路 (IC) >> 嵌入式 - 微處理器 系列:M683xx 標準包裝:2 系列:MPC8xx 處理器類型:32-位 MPC8xx PowerQUICC 特點:- 速度:133MHz 電壓:3.3V 安裝類型:表面貼裝 封裝/外殼:357-BBGA 供應(yīng)商設(shè)備封裝:357-PBGA（25x25） 包裝:托盤 |
| MC68302FE16 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Communications Controller |
| MC68302FE16C | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Communications Controller |
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