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參數(shù)資料
| 型號(hào)： | MC68HC08JK3EMDW |
| 廠商： | 飛思卡爾半導(dǎo)體(中國(guó))有限公司 |
| 英文描述： | Microcontrollers |
| 中文描述： | 微控制器 |
| 文件頁(yè)數(shù)： | 111/180頁(yè) |
| 文件大?。?/td> | 1018K |
| 代理商： | MC68HC08JK3EMDW |
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Port D
MC68HC908JL3E Family Data Sheet, Rev. 4
Freescale Semiconductor
111
10.4.2 Data Direction Register D (DDRD)
Data direction register D determines whether each port D pin is an input or an output. Writing a one to a
DDRD bit enables the output buffer for the corresponding port D pin; a zero disables the output buffer.
DDRD[7:0] — Data Direction Register D Bits
These read/write bits control port D data direction. Reset clears DDRD[7:0], configuring all port D pins
as inputs.
1 = Corresponding port D pin configured as output
0 = Corresponding port D pin configured as input
NOTE
Avoid glitches on port D pins by writing to the port D data register before
changing data direction register D bits from 0 to 1.
Figure 10-11
shows the
port D I/O logic.
Figure 10-11. Port D I/O Circuit
When DDRDx is a 1, reading address $0003 reads the PTDx data latch. When DDRDx is a 0, reading
address $0003 reads the voltage level on the pin. The data latch can always be written, regardless of the
state of its data direction bit.
Table 10-4
summarizes the operation of the port D pins.
Address:
$0007
Bit 7
6
5
4
3
2
1
Bit 0
Read:
DDRD7
DDRD6
DDRD5
DDRD4
DDRD3
DDRD2
DDRD1
DDRD0
Write:
Reset:
0
0
0
0
0
0
0
0
Figure 10-10. Data Direction Register D (DDRD)
READ DDRD ($0007)
WRITE DDRD ($0007)
RESET
WRITE PTD ($0003)
READ PTD ($0003)
PTDx
DDRDx
PTDx
I
PTD[0:3] To Analog-To-Digital Converter
PTD[4:5] To Timer
5k
PTDPU[6:7]
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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| MC68HC08JK8CDW | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
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