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參數(shù)資料
| 型號： | MC68HC08JK3EMDW |
| 廠商： | 飛思卡爾半導(dǎo)體(中國)有限公司 |
| 英文描述： | Microcontrollers |
| 中文描述： | 微控制器 |
| 文件頁數(shù)： | 112/180頁 |
| 文件大?。?/td> | 1018K |
| 代理商： | MC68HC08JK3EMDW |
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Input/Output (I/O) Ports
MC68HC908JL3E Family Data Sheet, Rev. 4
112
Freescale Semiconductor
10.4.3 Port D Control Register (PDCR)
The port D control register enables/disables the pull-up resistor and slow-edge high current capability of
pins PTD6 and PTD7.
SLOWDx — Slow Edge Enable
The SLOWD6 and SLOWD7 bits enable the Slow-edge, open-drain, high current output (25mA sink)
of port pins PTD6 and PTD7 respectively. DDRDx bit is not affected by SLOWDx.
1 = Slow edge enabled; pin is open-drain output
0 = Slow edge disabled; pin is push-pull
PTDPUx — Pull-up Enable
The PTDPU6 and PTDPU7 bits enable the 5k
Ω
pull-up on PTD6 and PTD7 respectively, regardless
the status of DDRDx bit.
1 = Enable 5k
Ω
pull-up
0 = Disable 5k
Ω
pull-up
Table 10-4. Port D Pin Functions
DDRD
Bit
PTD Bit
I/O Pin Mode
Accesses to
DDRD
Accesses to PTD
Read/Write
Read
Write
PTD[7:0]
(3)
0
X
(1)
1. X = don’t care.
2. Hi-Z = high impedance.
3. Writing affects data register, but does not affect the input.
Input, Hi-Z
(2)
DDRD[7:0]
Pin
1
X
Output
DDRD[7:0]
Pin
PTD[7:0]
Address:
$000A
Bit 7
6
5
4
3
2
1
Bit 0
Read:
0
0
0
0
SLOWD7
SLOWD6
PTDPU7
PTDPU6
Write:
Reset:
0
0
0
0
0
0
0
0
= Unimplemented
Figure 10-12. Port D Control Register (PDCR)
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MC68HC08JK8CDW | Microcontrollers |
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參數(shù)描述 |
|---|---|
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| MC68HC08JK8CDW | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
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| MC68HC08JK8MDW | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
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