參數(shù)資料
型號: MC68HC08JK3EMDW
廠商: 飛思卡爾半導體(中國)有限公司
英文描述: Microcontrollers
中文描述: 微控制器
文件頁數(shù): 128/180頁
文件大小: 1018K
代理商: MC68HC08JK3EMDW
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Low Voltage Inhibit (LVI)
MC68HC908JL3E Family Data Sheet, Rev. 4
128
Freescale Semiconductor
14.4 LVI Control Register (CONFIG2/CONFIG1)
The LVI module is controlled by three bits in the configuration registers, CONFIG1 and CONFIG2.
LVID — Low Voltage Inhibit Disable Bit
1 = Low voltage inhibit disabled
0 = Low voltage inhibit enabled
LVIT1, LVIT0 — LVI Trip Voltage Selection
These two bits determine at which level of V
DD
the LVI module will come into action. LVIT1 and LVIT0
are cleared by a Power-On Reset only.
14.5 Low-Power Modes
The STOP and WAIT instructions put the MCU in low-power-consumption standby modes.
14.5.1 Wait Mode
The LVI module, when enabled, will continue to operate in WAIT Mode.
14.5.2 Stop Mode
The LVI module, when enabled, will continue to operate in STOP Mode.
Address:
$001E
Bit 7
6
5
4
3
2
1
Bit 0
Read:
IRQPUD
R
R
LVIT1
LVIT0
R
R
R
Write:
Reset:
0
0
0
Not affected
Not affected
0
0
0
POR:
0
0
0
0
0
0
0
0
R
=Reserved
Figure 14-2. Configuration Register 2 (CONFIG2)
Address:
$001F
Bit 7
6
5
4
3
2
1
Bit 0
Read:
COPRS
R
R
LVID
R
SSREC
STOP
COPD
Write:
Reset:
0
0
0
0
0
0
0
0
R
=Reserved
Figure 14-3. Configuration Register 1 (CONFIG1)
LVIT1
LVIT0
Trip Voltage
(1)
1. See
Chapter 16 Electrical Specifications
for full parameters.
Comments
0
0
V
LVR3
(2.4V)
V
LVR3
(2.4V)
V
LVR5
(4.0V)
Reserved
For V
DD
=3V operation
For V
DD
=3V operation
For V
DD
=5V operation
0
1
1
0
1
1
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