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參數(shù)資料
| 型號(hào)： | MC68HC08JK3EMDW |
| 廠商： | 飛思卡爾半導(dǎo)體(中國(guó))有限公司 |
| 英文描述： | Microcontrollers |
| 中文描述： | 微控制器 |
| 文件頁數(shù)： | 92/180頁 |
| 文件大?。?/td> | 1018K |
| 代理商： | MC68HC08JK3EMDW |
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Timer Interface Module (TIM)
MC68HC908JL3E Family Data Sheet, Rev. 4
92
Freescale Semiconductor
8.9.4 TIM Channel Status and Control Registers (TSC0:TSC1)
Each of the TIM channel status and control registers does the following:
Flags input captures and output compares
Enables input capture and output compare interrupts
Selects input capture, output compare, or PWM operation
Selects high, low, or toggling output on output compare
Selects rising edge, falling edge, or any edge as the active input capture trigger
Selects output toggling on TIM overflow
Selects 0% and 100% PWM duty cycle
Selects buffered or unbuffered output compare/PWM operation
CHxF — Channel x Flag Bit
When channel x is an input capture channel, this read/write bit is set when an active edge occurs on
the channel x pin. When channel x is an output compare channel, CHxF is set when the value in the
TIM counter registers matches the value in the TIM channel x registers.
When TIM CPU interrupt requests are enabled (CHxIE=1), clear CHxF by reading the TIM channel x
status and control register with CHxF set and then writing a zero to CHxF. If another interrupt request
occurs before the clearing sequence is complete, then writing zero to CHxF has no effect. Therefore,
an interrupt request cannot be lost due to inadvertent clearing of CHxF.
Reset clears the CHxF bit. Writing a one to CHxF has no effect.
1 = Input capture or output compare on channel x
0 = No input capture or output compare on channel x
CHxIE — Channel x Interrupt Enable Bit
This read/write bit enables TIM CPU interrupt service requests on channel x. Reset clears the CHxIE
bit.
1 = Channel x CPU interrupt requests enabled
0 = Channel x CPU interrupt requests disabled
Address:
$0025
Bit 7
CH0F
0
0
TSC0
6
5
4
3
2
1
Bit 0
Read:
Write:
Reset:
CH0IE
MS0B
MS0A
ELS0B
ELS0A
TOV0
CH0MAX
0
0
0
0
0
0
0
Address:
$0028
Bit 7
CH1F
0
0
TSC1
6
5
0
4
3
2
1
Bit 0
Read:
Write:
Reset:
CH1IE
MS1A
ELS1B
ELS1A
TOV1
CH1MAX
0
0
0
0
0
0
0
= Unimplemented
Figure 8-7. TIM Channel Status and Control Registers (TSC0:TSC1)
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MC68HC08JK8CDW | Microcontrollers |
| MC68HC08JL3H | Microcontrollers |
| MC68HC08JT8 | M68HC08 Microcontrollers |
| MC68HC08KH12A | Microcontrollers |
| MC68HC08LT8 | Microcontrollers |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MC68HC08JK3EMP | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
| MC68HC08JK8 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
| MC68HC08JK8CDW | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
| MC68HC08JK8CP | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Addendum to MC68HC908JL8 Technical Data |
| MC68HC08JK8MDW | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
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