參數(shù)資料
型號(hào)： ML674001LA
廠商： LAPIS SEMICONDUCTOR CO LTD
元件分類(lèi)： 微控制器/微處理器
英文描述： 32-BIT, MROM, 33.333 MHz, RISC MICROCONTROLLER, PBGA144
封裝： 11 X 11 MM, 0.80 MM PITCH, PLASTIC, LFBGA-144
文件頁(yè)數(shù)： 231/440頁(yè)
文件大?。?/td> 2769K
代理商： ML674001LA
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ML674001 Series/ML675001 Series User’s Manual
Chapter 18
UART with FIFO(16byte)
18-27
18.3.4
Buffered Operation
Received Data Available Interrupts
Enabling both the receive queue and receive interrupts produces a received data available interrupt when
the number of characters in the queue exceeds the specified trigger level. The hardware immediately clears
this interrupt when the number of characters in the queue falls back to this trigger level.
The received data available bit in IIR is similar in operation. It goes to “1” when the number of characters
in the queue exceeds the specified trigger level and returns to “0” when the number of characters in the
queue falls back to this trigger level. It goes to “1” immediately after the hardware transfers the triggering
data from the receive shift register to the queue and returns to “0” when the queue becomes empty.
Receiver line status interrupts have higher priority than these interrupts.
Character Timeout Interrupts
Enabling both the receive queue and receive interrupts produces a character timeout interrupt when the
following conditions are met.
There is at least one character in the receive queue.
The time equivalent of at least four characters has elapsed since the last character was received (If the
frame format specifies two stop bits, the timer starts after the first stop bit.) or since the last character
was read off the queue.
If the frame format specifies one start bit, eight character bits, one parity bit, and two stop bits, for example,
the timeout interval for a transfer speed of 300 baud is approximately 160 ms.
The clock used to calculate the character time is CCLK.
Reading a character from the queue clears the character timeout interrupt and resets the timeout detection
timer.
If there is no character timeout interrupt pending, the hardware resets the timeout detection timer each time
that the CPU reads a character from the queue or the interface receives a new character.
Transmitter Holding Register Empty Interrupts
Enabling both the transmit queue and receive queue interrupts produces a transmitter holding register
empty interrupt when the transmit queue is empty. Writing a character to the transmit queue or reading IIR
clears this interrupt.
This interrupt is delayed by the time equivalent of the frame less the final stop bit when the following
conditions are met.
There is only a single character in the queue after the transmitter holding register empty (THRE) bit
goes to “1.”
The THRE bit goes to “1.”
相關(guān)PDF資料
PDF描述
ML67Q4003LA 32-BIT, FLASH, 33.333 MHz, RISC MICROCONTROLLER, PBGA144
ML67Q4002LA 32-BIT, FLASH, 33.333 MHz, RISC MICROCONTROLLER, PBGA144
ML67Q4003TC 32-BIT, FLASH, 33.333 MHz, RISC MICROCONTROLLER, PQFP144
ML67Q4002TC 32-BIT, FLASH, 33.333 MHz, RISC MICROCONTROLLER, PQFP144
ML69Q6500 32-BIT, FLASH, 120 MHz, RISC MICROCONTROLLER, PBGA272
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參數(shù)描述
ML674001TC 制造商:ROHM Semiconductor 功能描述:
ML675001 制造商:OKI 制造商全稱(chēng):OKI electronic componets 功能描述:32-bit ARM-Based General-Purpose Microcontroller
ML675001ALAZ03A 制造商:ROHM Semiconductor 功能描述:ARM7TDMI 32-BIT MCU 60 MHZ ROH
ML675001ATC 制造商:ROHM Semiconductor 功能描述:
ML675001ATCZ03A 制造商:ROHM Semiconductor 功能描述:
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