參數(shù)資料
型號: MPC5200B
廠商: 飛思卡爾半導體(中國)有限公司
英文描述: SDRAM/DDR Memory Controller
中文描述: 內存/ DDR存儲器控制器
文件頁數(shù): 33/78頁
文件大?。?/td> 629K
代理商: MPC5200B
Electrical and Thermal Characteristics
MPC5200B Data Sheet, Rev. 1
Freescale Semiconductor
33
Figure 14. PIO Mode Timing
Table 28. Multiword DMA Timing Specifications
Sym
Multiword DMA Timing Parameters
Min/Max
Mode 0(ns)
Mode 1(ns)
Mode 2(ns)
SpecID
t
0
Cycle Time
min
480
150
120
A8.12
t
C
DMACK to DMARQ delay
max
A8.13
t
D
DIOR/DIOW pulse width (16-bit)
min
215
80
70
A8.14
t
E
DIOR data access
max
150
60
50
A8.15
t
G
DIOR/DIOW data setup
min
100
30
20
A8.16
t
F
DIOR data hold
min
5
5
5
A8.17
t
H
DIOW data hold
min
20
15
10
A8.18
t
I
DMACK to DIOR/DIOW setup
min
0
0
0
A8.19
t
J
DIOR/DIOW to DMACK hold
min
20
5
5
A8.20
t
Kr
DIOR negated pulse width
min
50
50
25
A8.21
t
Kw
DIOW negated pulse width
min
215
50
25
A8.22
t
Lr
DIOR to DMARQ delay
max
120
40
35
A8.23
t
Lw
DIOW to DMARQ delay
max
40
40
35
A8.24
WDATA
RDATA
IORDY
t
0
t
1
t
2
t
3
t
4
t
5
t
6
t
9
t
A
t
B
CS[0]/CS[3]/DA[2:0]
DIOR/DIOW
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