參數(shù)資料
型號(hào)： MPC5553MZP132
廠商： Freescale Semiconductor
文件頁數(shù)： 43/68頁
文件大小： 0K
描述： IC MCU MPC5553 REV A 416-PBGA
產(chǎn)品培訓(xùn)模塊： MPC55xx PitchPak Family
標(biāo)準(zhǔn)包裝： 200
系列： MPC55xx Qorivva
核心處理器： e200z6
芯體尺寸： 32-位
速度： 132MHz
連通性： CAN，EBI/EMI，以太網(wǎng)，SCI，SPI
外圍設(shè)備： DMA，POR，PWM，WDT
輸入/輸出數(shù)： 220
程序存儲(chǔ)器容量： 1.5MB（1.5M x 8）
程序存儲(chǔ)器類型： 閃存
RAM 容量： 64K x 8
電壓 - 電源 (Vcc/Vdd)： 1.35 V ~ 1.65 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 40x12b
振蕩器型： 外部
工作溫度： -40°C ~ 125°C
封裝/外殼： 416-BBGA
包裝： 托盤
配用： MPC5553EVBISYS-ND - KIT EVAL ISYSTEMS MPC5553
MPC5553EVBGHS-ND - KIT EVAL GREEN HILLS SOFTWARE
MPC5553EVB-ND - KIT EVAL MPC5553MZP132
MPC5553EVBE-ND - BOARD EVAL FOR MPC5553
MPC5553 Microcontroller Data Sheet, Rev. 4
Electrical Characteristics
Freescale Semiconductor
48
3.14.3
MII FEC Asynchronous Inputs Signal Timing
FEC_CRS and FEC_COL
Table 30 lists MII FEC asynchronous input signal timing.
Figure 30 shows MII FEC asynchronous input timing listed in Table 30.
Figure 30. MII FEC Asynchronous Inputs Timing Diagram
3.14.4
MII FEC Serial Management Channel Timing
FEC_MDIO and FEC_MDC
Table 31 lists MII FEC serial management channel timing. The FEC functions correctly with a maximum
FEC_MDC frequency of 2.5 MHz.
Figure 31 shows MII FEC serial management channel timing listed in Table 31.
Table 30. MII FEC Asynchronous Inputs Signal Timing
Spec
Characteristic
Min.
Max
Unit
9
FEC_CRS, FEC_COL minimum pulse width
1.5
—
FEC_TX_CLK period
Table 31. MII FEC Serial Management Channel Timing
Spec
Characteristic
Min.
Max
Unit
10
FEC_MDC falling-edge to FEC_MDIO output invalid
(minimum propagation delay)
0—
ns
11
FEC_MDC falling-edge to FEC_MDIO output valid
(maximum propagation delay)
—25
ns
12
FEC_MDIO (input) to FEC_MDC rising-edge setup
10
—
ns
13
FEC_MDIO (input) to FEC_MDC rising-edge hold
0
—
ns
14
FEC_MDC pulse-width high
40%
60%
FEC_MDC period
15
FEC_MDC pulse-width low
40%
60%
FEC_MDC period
FEC_CRS, FEC_COL
9
相關(guān)PDF資料
PDF描述
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VE-222-IX-F3 CONVERTER MOD DC/DC 15V 75W
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參數(shù)描述
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