參數資料
型號： MPC566MZP56
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 微控制器/微處理器
英文描述： 32-BIT, FLASH, 56 MHz, RISC MICROCONTROLLER, PBGA388
封裝： 27 X 27 MM, 1 MM PITCH, PLASTIC, MO-151AAL-1, BGA-388
文件頁數： 509/1387頁
文件大?。?/td> 18462K
代理商： MPC566MZP56
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MOTOROLA
Chapter 3. Central Processing Unit
3-55
Operating Environment Architecture (OEA)
NOTE
For load or store instructions that use register indirect with
index addressing, the DSISR can be set to the same value that
would have resulted if the corresponding instruction uses
register indirect with immediate index addressing had caused
the exception. Similarly, for load or store instructions that use
register indirect with immediate index addressing, DSISR can
hold a value that would have resulted from an instruction that
uses register indirect with index addressing. (If there is no
corresponding instruction, no alternative value can be
specified.)
When an alignment exception is taken, instruction execution resumes at offset 0x00600
from the physical base address indicated by MSR[IP].
3.15.4.7 Program Exception (0x0700)
A program exception occurs when no higher priority exception exists and one or more of
the following exception conditions, which correspond to bit settings in SRR1, occur during
execution of an instruction:
System floating-point enabled exception — A system floating-point enabled
exception is generated when the following condition is met as a result of a move to
FPSCR instruction, move to MSR (mtmsr) instruction, or return from interrupt (rfi)
instruction:
(MSR[FE0] | MSR[FE1]) & FPSCR[FEX] = 1.
Notice that in the RCPU implementation of the MPC500 architecture, a program
interrupt is not generated by a floating-point arithmetic instruction that results in the
condition shown above; a floating-point assist exception is generated instead.
Privileged instruction — A privileged instruction type program exception is
generated by any of the following conditions:
— The execution of a privileged instruction (mfmsr, mtmsr, or rfi) is attempted and
the processor is operating at the user privilege level (MSR[PR] = 1).
— The execution of mtspr or mfspr where SPR0 = 1 in the instruction encoding
(indicating a supervisor-access register) and MSR[PR] = 1 (indicating the
processor is operating at the user privilege level), provided the SPR instruction
field encoding represents either:
— a valid internal-to-the-processor special-purpose register; or
— an external-to-the-processor special-purpose register (either valid or invalid).
Trap — A trap type program exception is generated when any of the conditions
specified in a trap instruction is met.
相關PDF資料
PDF描述
MPC566CZP40 32-BIT, FLASH, 40 MHz, RISC MICROCONTROLLER, PBGA388
MPC565CVR40 32-BIT, FLASH, 40 MHz, RISC MICROCONTROLLER, PBGA388
MPC565MZP56R2 32-BIT, FLASH, 56 MHz, RISC MICROCONTROLLER, PBGA388
MPC565CVR56 32-BIT, FLASH, 56 MHz, RISC MICROCONTROLLER, PBGA388
MPC60333 32-BIT, 33.33 MHz, RISC PROCESSOR, CQFP240
相關代理商/技術參數
參數描述
MPC566MZP56 制造商:Freescale Semiconductor 功能描述:32-BIT MICROCONTROLLER IC POWER 5xx 56
MPC5673F 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:MPC5674F Microcontroller Data Sheet
MPC5673K 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontroller is a 32-bit embedded controller designed for advanced
MPC5674ADAT516 制造商:Freescale Semiconductor 功能描述:ADAPTER BOARD FOR MPC567 - Boxed Product (Development Kits)
MPC5674F 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:MPC5674F Microcontroller Data Sheet
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